■書籍
- 渡邊 実,「8章 新しいデバイス,アーキテクチャ」,
FPGAの原理と構成,オーム社,pp. 272-284, 4月, 2016. - M. Watanabe, “High-Performance Computing Based on High-Speed Dynamic Reconfiguration,”
High-Performance Computing Using FPGAs, Chapter 20, pp. 605-627, Springer, June, 2013. - 渡邊 実,「第4章 高速な木探索回路を実現する」,
ディジタル・デザイン・テクノロジ No.15,CQ出版社,pp. 65-76, 10月, 2012. - M. Watanabe, “A dynamically Reconfigurable Device,”
Advances in Solid State Circuit Technologies, IN-TECH (ISBN 978-953-307-086-5),
Invited book chapter, April, 2010. - M. Watanabe, “Fault tolerance of programmable devices,”
Parallel and Distributed Computing, IN-TECH (ISBN 978-953-307-057-5),
Invited book chapter, pp. 1 -10, Jan., 2010. - M. Watanabe, “Optoelectronic Device using a Liquid Crystal Holographic Memory,”
New Developments in Liquid Crystals, IN-TECH (ISBN 978-953-307-015-5),
Invited book chapter, pp. 219-234, Nov., 2009.
■学術論文
- Kakeru Ando, Minoru Watanabe, Nobuya Watanabe, “Optical multi-context scrubbing operation on a redundant system,” Optics Express 31(23) 38529-38529, Oct., 2023
DOI:10.1364/oe.500666 - Akifumi Ogiwara, Minoru Watanabe, “Analysis of optical properties and internal structures of γ-ray-irradiated holographic devices formed using liquid crystal composites,”
Optical Materials, Vol.123, pp. 111932-111932, Dec., 2021.
DOI: 10.1016/j.optmat.2021.111932 - Akifumi Ogiwara, Makishi Toda, Junya Ishido, Minoru Watanabe, and Hiroshi Kakiuchida,
“Effects of a radiation dose in gamma-ray irradiation fields on holographic gratings formed by liquid crystal composites,”
OSA Continuum, Vol. 4, No. 2, pp. 514-528, Feb., 2021.
(OSA Publishing: Open Access)
DOI: 10.1364/OSAC.415702 - Y. Takaki, M. Watanabe, “Optical multi-context blind scrubbing for field programmable gate arrays,”
IEEE Photonics Journal, Vol. 12, Issue 6, 7801411, Dec., 2020.
(OSA Publishing: Open Access)
DOI: 10.1109/JPHOT.2020.3038900 - H. Shinba, M. Watanabe, “Radiation-hardened configuration-context realization for field programmable gate arrays,”
Applied Optics, Vol. 59, Issue 19, pp. 5680-5686, June, 2020.
(OSA Publishing: Open Access)
DOI: 10.1364/AO.396525 - T. Fujimori, M. Watanabe, “Optically reconfigurable gate array using a colored configuration,” Applied Optics, Vol. 57, Issue 29, pp. 8625-8631, Oct., 2018.
(OSA Publishing: Open Access)
DOI: 10.1364/AO.57.008625 - I.S.A. Halim, F. Kobayashi, M. Watanabe, K. Mashiko, O.C. Yee,
“Small Area Implementation for Optically Reconfigurable Gate Array VLSI:FFT Case,”
Journal of Scientific & Industrial Research, Vol. 76, pp, 697-700, Nov., 2017.
http://nopr.niscpr.res.in/handle/123456789/43037 - T. Fujimori, M. Watanabe,
“Parallel light configuration that increases the radiation tolerance of integrated circuits,”
Optics Express, Vol. 25, Issue 23, pp. 28136-28145, Nov., 2017.
DOI: 10.1364/OE.25.028136 - A. Ogiwara, M. Watanabe, Y. Ito,
“Effects of gamma-ray irradiation on holographic polymer-dispersed liquid crystal memory,”
Applied Optics, Vol. 56, Issue 16, pp. 4854-4860, May, 2017.
DOI: 10.1364/AO.56.004854 - T. Fujimori, M. Watanabe,
“High-speed scrubbing demonstration using an optically reconfigurable gate array,”
Optics Express, Vol. 25, Issue 7, pp. 7807-7817, March, 2017.
DOI: 10.1364/OE.25.007807 - 渡邊 実,佐野 健太郎,高前田 伸也,三好 健文,中條 拓伯,
“FPGAハードウエア・アクセラレーション向け日の丸高位合成ツール”
電子情報通信学会論文誌, Vol. J100-B, No. 1, pp.1-10, Jan. 2017. (招待論文)
DOI: https://search.ieice.org/bin/summary.php?id=j100-b_1_1[IEICE] - A. Ogiwara, M. Watanabe,
“Effects of multi-context information recorded at different regions in holographic polymer-dispersed liquid crystal on optical reconfiguration,”
Japanese Journal of Applied Physics, Vol. 55, No. 8S3, pp. 08RG04-1 – 08RG04-6, July, 2016.
DOI: 10.7567/JJAP.55.08RG04[JJAP] - M. Watanabe,
“Quality recovery method of interference patterns generated from faulty MEMS spatial light modulators,”
IEEE/OSA Journal of Lightwave Technology, vol. 34, Issue 3, pp. 910-917, Feb., 2016.
DOI: 10.1109/JLT.2015.2483622(IEEE Xplore: Open Access) - A. Ogiwara, M. Watanabe,
“Formation of holographic polymer-dispersed liquid crystal memory by angle-multiplexing recording for optically reconfigurable gate arrays,”
Applied Optics, Vol. 54, Issue 36, pp. 10623-10629, Dec. 2015.
DOI: 10.1364/AO.54.010623 - D. Seto, M. Watanabe,
”Radiation-hardened optically reconfigurable gate array exploiting holographic memory characteristics,”
Japanese Journal of Applied Physics, vol. 54, no. 9S, pp. 09MA06-1 – 09MA06-5, 2015.
DOI: 10.7567/JJAP.54.09MA06 - M. Watanabe, S. Kawahito,
“Radiation tolerance experiment for a dynamically reconfigurable vision architecture,”
International Journal of Image Processing Techniques, vol. 2, issue 1, pp. 59-62, April, 2015.
DOI: 10.15224/ 978-1-63248-034-7-109 - A. Ogiwara, M. Watanabe, R. Moriwaki,
“Temperature dependence of anisotropic diffraction in holographic polymer-dispersed liquid crystal memory,”
Applied Optics, Vol. 52, Issue 26, pp. 6529-6536, Sep., 2013.
DOI: 10.1364/AO.52.006529 - A. Ogiwara, M. Watanabe, R. Moriwaki,
“Formation of temperature dependable holographic memory using holographic polymer dispersed liquid crystal,”
Optics letters, Vol. 38, Issue 7, pp. 1158–1160, April, 2013.
DOI: 10.1364/OL.38.001158 - R. Moriwaki, M. Watanabe,
“Optical configuration acceleration on a new optically reconfigurable gate array VLSI using a negative logic implementation,”
Applied Optics, Vol. 52, No. 9, pp. 1939–1946, March, 2013.
DOI: 10.1364/AO.52.001939 - A. Ogiwara, M. Watanabe,
“Optical reconfiguration by anisotropic diffraction in holographic polymer-dispersed liquid crystal memory,”
Applied Optics, Vol. 51, Iss. 21, pp. 5168–5177, July, 2012.
DOI: 10.1364/AO.51.005168 - A. Ogiwara, M. Watanabe, T. Mabuchi, F. Kobayashi,
“Holographic polymer-dispersed liquid crystal memory for optically reconfigurable gate array using subwavelength grating mask,”
Applied Optics, Vol. 50, Iss. 34, pp. 6369–6376, Nov., 2011.
DOI: 10.1364/AO.50.006369 - T. Watanabe, M. Watanabe,
“Robust holographic storage system design,”
Optics Express, Vol. 19, No. 24, pp. 24147–24158, Nov., 2011.
DOI: 10.1364/OE.19.024147 (OSA Publishing: Open Access) - S. Kubota, M. Watanabe,
“A four-context programmable optically reconfigurable gate array with a reflective silver-halide holographic memory,”
IEEE Photonics Journal, Vol. 3, No. 4, pp. 665–675, Aug., 2011.
DOI: 10.1109/JPHOT.2011.2160335 (IEEE Xplore: Open Access) - M. Nakajima, M. Watanabe,
“Fast optical reconfiguration of a nine-context DORGA using a speed adjustment control,”
ACM Transaction on Reconfigurable Technology and Systems, Vol. 4, Issue 2, May, 2011.
DOI: 10.1145/1968502.1968506 - D. Seto, M. Nakajima, M. Watanabe,
“Dynamic optically reconfigurable gate array very large-scale integration with partial reconfiguration capability,”
Applied Optics, Vol. 49, Iss. 36, pp. 6986–6994, Dec., 2010.
DOI: 10.1364/AO.49.006986(OSA Publishing: Open Access) - Y. Ueno, M. Watanabe,
“Fiber remote configuration for an optically reconfigurable gate array with four configuration contexts,”
Optics Communications, vol. 283, Issue 23, pp. 4614-4618, Dec., 2010.
DOI: 10.1016/j.optcom.2010.06.090 - H. Morita, M. Watanabe,
“Microelectromechanical Configuration of an Optically Reconfigurable Gate Array,”
IEEE Journal of Quantum Electronics, Vol. 46, Issue 9, pp. 1288 – 1294, Sep., 2010.
DOI: 10.1109/JQE.2010.2047378 - A. Ogiwara, M. Watanabe, T. Mabuchi, F. Kobayashi,
“Formation of holographic memory for defect tolerance in optically reconfigurable gate arrays,”
Applied Optics, Vol. 49, No. 22, pp. 4255-4261, Aug., 2010.
DOI: 10.1364/AO.49.004255 - T. Mabuchi, M. Watanabe,
“A superimposing acceleration and optimization method of optical reconfiguration speed without any increase of laser power,”
Applied Optics, Vol. 49, No. 22, pp. 4120–4126, Aug., 2010. - M. Nakajima, M. Watanabe,
“Optical buffering technique under space radiation environment,”
Optics Letters, Vol. 34, Issue 23, pp. 3719-3721, Dec., 2009. - M. Nakajima, M. Watanabe,
“A four-context optically differential reconfigurable gate array,”
IEEE/OSA Journal of Lightwave Technology, Vol. 27, No 20, pp. 4460-4470, Oct., 2009.
https://opg.optica.org/jlt/viewmedia.cfm?uri=jlt-27-20-4460&seq=0 - M. Watanabe, T. Shiki, F. Kobayashi,
“Scaling prospect of optically differential reconfigurable gate array VLSIs,”
Analog Integrated Circuits and Signal Processing, Vol. 60, Issue 1-2, pp. 137 – 143, Aug., 2009.
DOI: 10.1007/s10470-008-9210-9 - S. Kubota, M. Watanabe,
“Programmable Optically Reconfigurable Gate Array Architecture and its writer,”
Applied Optics, Vol. 48, Issue 2, pp. 302–308, Jan., 2009.
DOI: 10.1364/AO.48.000302 - M. Watanabe, M. Nakajima, S. Kato,
“An inversion/non-inversion dynamic optically reconfigurable gate array VLSI,”
World Scientific and Engineering Academy and Society Transactions on Circuits and Systems, Issue 1, Vol. 8, pp. 11- 20, Jan., 2009.
https://www.naun.org/main/NAUN/circuitssystemssignal/cssp-72.pdf - N. Yamaguchi, M. Watanabe,
“Liquid crystal holographic configurations for optically reconfigurable gate arrays,”
Applied Optics, Vol. 47, No. 28, pp. 4692-4700, Oct., 2008.
DOI: 10.1364/AO.47.004692 - D. Seto, M. Watanabe,
“A dynamic optically reconfigurable gate array – perfect emulation,”
IEEE Journal of Quantum Electronics, Vol. 44, Issue 5, pp. 493-500, May, 2008.
DOI: 10.1109/JQE.2008.916705 - M. Miyano, M. Watanabe, F. Kobayashi,
“Optically Differential Reconfigurable Gate Array,”
Electronics and Computers in Japan, Part II, Issue 11, vol. 90, pp.132-139, Nov., 2007.
DOI: 10.1002/ecjb.20420 - 井上,小林,渡邊実,
“時間領域フーリエ補間による非同期サンプリング・レート・コンバータ,”
計測自動制御学会論文集, vol. 43, No. 2, pp. 145-152, Feb., 2007.
DOI: 10.9746/ve.sicetr1965.43.145 - M. Watanabe, F. Kobayashi,
“Manufacturing-defect tolerance analysis of optically reconfigurable gate arrays,”
World Scientific and Engineering Academy and Society Transactions on Signal Processing, Issue 11, Vol. 2, pp. 1457- 1464, Nov., 2006. - 井上,小林,渡邊実,
“位相補間によるPLLの特性改善“,
計測自動制御学会論文集, Vol.42, No. 10, pp. 1175-1180, Oct., 2006.
DOI: 10.9746/sicetr1965.42.1175 - 渡邊実,小林,
“高密度ダイナミック光再構成型ゲートアレーVLSI”,
電子情報通信学会論文誌, Vol.J89-D, No.6, pp.1082-1090, June, 2006.
https://search.ieice.org/bin/summary.php?id=j89-d_6_1082&category=D&year=2006&lang=J&abst= - M. Watanabe, F. Kobayashi, “Dynamic Optically Reconfigurable Gate Array,”
Japanese Journal of Applied Physics, Vol. 45, No. 4B, pp. 3510-3515, April, strong>2006.
DOI: 10.1143/JJAP.45.3510 - 渡邊実, 小林,
“部分再構成が可能な光再構成型ゲートアレイVLSI”,
電子情報通信学会論文誌, Vol. J86-C, No. 8, pp. 869-877, Aug. 2003. - T. Sotohebo, M. Watanabe, F. Kobayashi,
“FPGA implementation of Finite Physical Quantity Neural Network,”
Journal of Robotics and Mechatronics, Vol. 15, No. 2, pp. 136-142, April, strong>2003.
DOI: 10.20965/jrm.2003.p0136 - M. Watanabe, J. Ohtsubo,
“Digital associative memory neural network with optical learning capability,”
Optics Communications, Vol.113, pp. 31-38, Dec., 1994.
DOI: 10.1016/0030-4018(94)90588-6
■解説論文
- 渡邊 実,「FPGAによる自動車の自動走行コンテスト」,情報・システムソサイエティ誌第24 巻第3 号(通巻96 号), 11月,2019.
- 渡邊 実,「強放射線環境下で使用できる耐放射線FPGA」,電気評論,pp. 50-54,5月,2018.
- 渡邊 実,「リコンフィギャラブルシステム研究フィールドでの生き残りをかけて」,電子情報通信学会会誌,Vol. 100, No. 10, p. 1055,10月,2017.
- 渡邊 実,「ホログラムメモリを活用した光再構成型ゲートアレイ」,オプトニューズ, Vol.9, No.5, pp. 19-23, 1月, 2015.
- 渡邊実, 小林, “ニューラルネットワークVLSI,” 計測と制御, Vol. 40, No.12, pp. 893-896, 2001.
■招待講演
- 渡邊 実,パネルタイトル「FPGAデザインコンテスト」,パネルディスカッション 「自律型モビリティシステムとドメイン特化型ハードウェアやFPGA技術の未来」,電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),9月7日,2022.
- Minoru Watanabe, “Radiation-hardened optically reconfigurable gate array”, Global Summit and Expo on Nanotechnology and Nanomaterials (GSENN), Copenhagen, Denmark, June, 2022.
- Minoru Watanabe, “Radiation-hardened optically reconfigurable gate array”,
International Meet & Expo on Laser, Optics and Photonics, Nice, France, Nov., 2021. - Minoru Watanabe, “High speed scrubbing on an optically reconfigurable gate array”,
Global Summit and Expo on Nanotechnology and Nanomaterials, Osaka, Japan, April, 2021. - Minoru Watanabe, Junya Ishido, “Multi-context holographic memory exploiting a wavelength-dependent optimization technique,”
IEEE International Conference on Photonics, Kelantan, Malaysia, May, 2020. - 渡邊 実「耐放射線・光電子デバイス」,10回 静岡大-核融合科学研究所連携研究フォーラム,静岡大学,11月30日,2018.
- Minoru Watanabe, “Optically Reconfigurable Gate Array,” DA NEXT BIG THING ROBO, Abu Dhabi, Sep., 2018.
- Minoru Watanabe,”Dependable Optically Reconfigurable Gate Array Architecture,”
International Symposium on Optical Memory, pp. 210-211, Hsinchu, Taiwan, Oct., 2014. - Minoru Watanabe,
“Dependable optically reconfigurable gate array,”
2012 International Workshop on Advanced Nanovision Science, pp. 47-50, Jan., 2012. - Minoru Watanabe,
“Novel dynamic module multiple redundancy for optically reconfigurable gate arrays,”
IEEE International Midwest Symposium on Circuits & Systems, CD-ROM, Seoul, Korea, Aug., 2011. - Minoru Watanabe,
“Development of optically reconfigurable gate arrays,”
International Symposium on Optical Memory, pp. 188-189, Hualien, Taiwan, Oct., 2010. - 渡邊実, 「光再構成型ゲートアレイの応用」,リコンフィギャラブル研究会,静岡大学 工学部,9月,2010.
- 渡邊実,「高速動的再構成が可能な光再構成型ゲートアレイ」,レーザー学会学術講演会第29回年次大会, 1月, 2009.
- M. Watanabe, M. Nakajima,
“An inversion/non-inversion dynamic optically reconfigurable gate array,”
World Scientific and Engineering Academy and Society International Conference on CIRCUITS, pp. 249-254, July, 2008. - M. Watanabe, F. Kobayashi,
“High manufacturing defect- tolerance optically programmable architecture,”
World Scientific and Engineering Academy and Society International Conference on circuits, systems, electronics, control & signal processing, pp.197-203, Dallas, USA, 2006.
■受賞
●Best Paper Award (6)
- Best Paper Award, M. Watanabe,
International Electronics Symposium (IES), IEEE, Aug.,2024. - Best Paper Award, M. Watanabe,
IEEE Annual Computing and Communication Workshop and Conference (IEEE), Jan., 2022. - Best Paper Award, M. Watanabe,
IEEE Annual Computing and Communication Workshop and Conference, Jan., 2017. - Excellent Oral Presentation Award, M. Watanabe,
International Conference on Mechanical and Aerospace Engineering, July, 2016. - Best Paper Award, T. Yoza, M. Watanabe,
International Workshop on Applied Reconfigurable Computing, April, 2014. - Presentation Master Award, K. Akagi, M. Watanabe,
International Workshop on Innovative Architecture for Future Generation High-Performance Processors and Systems, March, 2014. - Best Paper Award, D. Seto, M. Watanabe,
NASA/ESA Conference on Adaptive Hardware and Systems, June, 2010. - Best System Integration Award, M. Watanabe, D. Seto, S. Kubota,
IEEE International Symposium on System Integration, Dec., 2008.
●Best Poster Award (2)
- Best Poster Award, M. Watanabe,
International Workshop on Highly Efficient Accelerators and Reconfigurable Technologies, June, 2013. - Best Poster Award, D. Seto, M. Watanabe,
IEEE International Symposium on Micro-NanoMechatronics and Human Science, Nov., 2009.
●Best Student Paper Award (2)
- Best Student Paper Award, Yoshizumi Ito,
IEEE International Conference on Aerospace Electronics and Remote Sensing Technology, Dec., 2015. - Best Student Paper Award, M. Seo,
International Conference on Space Optical Systems and Applications, May, 2014.
●FPGAデザインコンテスト(国際大会)の受賞
- (世界一位) Champion in FPGA Design Contest 2017,
T. Fujimori, Y. Ito, R. Terada, S. Fujisaki, T. Hatamochi, H. Shinba, M. Watanabe,
International Workshop on Highly Efficient Accelerators and Reconfigurable Technologies, July, 2017. - (世界一位) First Place in FPGA Design Competition 2016,
T. Fujimori, Y. Ito, R. Terada, S. Fujisaki, T. Hatamochi, H. Shinba, M. Watanabe,
International Conference on Field-Programmable Technology, Dec. 2016. - (世界一位) First Place of the Limited Category in the FPGA Design Competition,
T. Fujimori, Y. Ito, T. Akabe, M. Watanabe,
International Workshop on Highly Efficient Accelerators and Reconfigurable Technologies , July, 2016. - (世界一位) First Place of the Unlimited Category in the FPGA Design Competition,
T. Fujimori, Y. Ito, T. Akabe, M. Watanabe,
International Workshop on Highly Efficient Accelerators and Reconfigurable Technologies, July, 2016. - (世界一位) First Place in FPGA Design Competition 2015,
T. Fujimori, T. Akabe, Y. Ito, K. Akagi, S. Furukawa, A. Tanibata, M. Watanabe,
International Conference on Field-Programmable Technology, Dec. 2015. - (世界一位) First Place in the MathWorks Blokus Duo Design Contest,
T. Fujimori, M. Seo, K. Akagi, S. Furukawa, H. Ito, M. Watanabe,
International Workshop on Highly Efficient Accelerators and Reconfigurable Technologies, June, 2015. - (世界一位) Winner of the Open League in FPGA Design Contest 2014 AISO CUP,
T. Fujimori, M. Seo, K. Akagi, R. Moriwaki, T. Yoza, Y. Torigai, M. Watanabe,
International Workshop on Highly Efficient Accelerators and Reconfigurable Technologies, June, 2014. - (世界一位) Champion of the Regulation League in FPGA Design Contest 2014 AISO CUP,
T. Fujimori, M. Seo, K. Akagi, R. Moriwaki, T. Yoza, Y. Torigai, M. Watanabe,
International Workshop on Highly Efficient Accelerators and Reconfigurable Technologies, June, 2014. - (世界一位) HDL Champion of the Regulation League in FPGA Design Contest 2014 AISO CUP,
T. Fujimori, M. Seo, K. Akagi, R. Moriwaki, T. Yoza, Y. Torigai, M. Watanabe,
International Workshop on Highly Efficient Accelerators and Reconfigurable Technologies, June, 2014. - (世界一位) First Place in ICFPT Design Competition 2013,
T. Yoza, R. Moriwaki, Y. Torigai, Y. Kamikubo, T. Kubota, T. Watanabe, T. Fujimori, H. Ito, M. Seo, K. Akagi, Y. Yamaji, M. Watanabe,
IEEE International Conference on Field-Programmable Technology, Dec. 2013. - (世界一位) First Place in FPGA Design Contest 2013 AISO CUP HDL,
T. Yoza, R. Moriwaki, Y. Torigai, Y. Kamikubo, T. Kubota, T. Watanabe, T. Fujimori, H. Ito, M. Seo, K. Akagi, Y. Yamaji, M. Watanabe,
IEEE International Conference on Field-Programmable Technology, Dec. 2013. - (世界一位) First Place in ICFPT Design Competition 2012,
R. Moriwaki, T. Yoza, Y. Kamikubo, Y. Torigai, A. Tanikawa, T. Kubota, H. Ito, Y. Shirahashi, M. Watanabe,
IEEE International Conference on Field-Programmable Technology, Dec. 2012. - (世界一位) First Place in FPGA Design Contest 2012 Connect6 Revenge,
R. Moriwaki, T. Yoza, T. Watanabe, Y. Kamikubo, Y. Torigai, Y. Shirahashi, H. Ito, T. Kubota, A. Tanikawa, Y. Yamaji, Y. Aoyama, M. Seo, M. Watanabe,
International Workshop on Highly Efficient Accelerators and Reconfigurable Technologies, June, 2012. - (世界一位) First Place in ICFPT Design Competition 2011,
T. Watanabe, R. Moriwaki, Y. Yamaji, Y. Kamikubo, Y. Torigai, Y. Nihira, T. Yoza, Y. Ueno, Y. Aoyama, M. Watanabe,
“An FPGA Connect6 Solver with a Two-Stage Pipelined Evaluation,”
IEEE International Conference on Field-Programmable Technology, Dec. 2011. - (世界二位) Second Prize in FPGA Design Contest 2014,
T. Fujimori, R. Moriwaki, M. Seo, K. Akagi, H. Ito, T. Kubota, S. Furukawa, M. Watanabe,
International Conference on Field-Programmable Technology, Dec. 2014. - (世界二位) Second Place in ICFPT Design Competition 2010,
T. Mabuchi, T. Watanabe, R. Moriwaki, Y. Aoyama, A. Gundjalam, Y. Yamaji, H. Nakada, M Watanabe,
IEEE International Conference on Field-Programmable Technology, Dec. 2010. - (世界三位) Third Prize in FPGA Design Contest 2014,
T. Fujimori, R. Moriwaki, M. Seo, K. Akagi, H. Ito, T. Kubota, S. Furukawa, M. Watanabe,
International Conference on Field-Programmable Technology, Dec. 2014.
●FPGAデザインコンテスト(国内大会)の受賞
- (日本一位) エンベデッド部門 優勝,
第7回 相磯秀夫杯 デザインコンテスト(The 2nd RECONF/CPSY/ARC/GI Trax デザインコンペティション),
藤森卓巳,伊藤芳純,渡邊実,FIT2016 第15回情報科学技術フォーラム イベント企画,2016年9月. - (日本一位) 一般部門 優勝,
第7回 相磯秀夫杯 デザインコンテスト(The 2nd RECONF/CPSY/ARC/GI Trax デザインコンペティション),
藤森卓巳,伊藤芳純,渡邊実,FIT2016 第15回情報科学技術フォーラム イベント企画,2016年9月. - (日本一位) エンベデッド部門 優勝,
第6回 相磯秀夫杯 デザインコンテスト(The 1st RECONF/CPSY/ARC/GI Trax デザインコンペティション),
藤森卓巳,赤部知也,伊藤芳純,瀬尾真人,赤木昂太,古川晋也,渡邊実,FIT2015 第14回情報科学技術フォーラム イベント企画,2015年9月. - (日本一位) 一般部門 優勝,
第6回 相磯秀夫杯 デザインコンテスト(The 1st RECONF/CPSY/ARC/GI Trax デザインコンペティション),
藤森卓巳,赤部知也,伊藤芳純,瀬尾真人,赤木昂太,古川晋也,渡邊実,FIT2015 第14回情報科学技術フォーラム イベント企画,2015年9月. - (日本一位) 優勝,第3回相磯秀夫杯FPGAデザインコンテスト,
森脇烈,余座貴志,渡邊貴弘,鳥飼勇希,上窪勇貴,山地勇一郎,窪田貴之,伊藤宏幸,渡邊実,
電子情報通信学会・リコンフィギャラブルシステム研究会,2013年9月. - (日本一位) 優勝,第1回相磯秀夫杯FPGAデザインコンテスト,
渡辺貴弘,森脇烈,山地勇一郎,上窪勇貴, 鳥飼勇希,仁平優基,余座貴志,上野由美子,青山裕司,渡邊実,
電子情報通信学会・リコンフィギャラブルシステム研究会,2011年11月.
●その他の賞
- 社会貢献賞(岡山大学), 渡邊実, 渡邊誠也, 2023年3月
- 教育功労賞,渡邊実,「FPGA自動運転競技大会によるディジタルシステム教育の普及」,電子情報通信学会,2022年3月
- 卓越研究者(静岡大学),渡邊実,2014年1月.
- 優秀賞,森田 裕宣,渡邊実,
「ホログラム閾値可変によるMEMSダイナミック光再構成型ゲートアレイの動作効率改善法」,
第8回 情報学ワークショップ(WiNF 2010), 2010年12月. - 2005ベストセッション講演賞,「動的再構成によるシステムの実現」,
渡邊実,小林,システムインテグレーション,計測自動制御学会,2005年12月18日 - Finalist Commendation, The Takeda Techno-Entrepreneurship Award, “Development of an optically reconfigurable gate array and implementation of a reconfigurable processor”,
M. Watanabe, F. Kobayashi, J. Ohtsubo, T. Otsuji, Takeda Foundation, December, 2001.
●学生の受賞
- 学生奨励賞, 情報処理学会第85回全国大会, 辻野 将, 2023年3月
- Best Paper Award, IEEE Annual Computing and Communication Workshop and Conference (IEEE), A. Ushiroyama, Jan., 2022.
- 優秀プレゼンテーション賞,パルテノン研究会,尾崎洸人,2021年12月
- IEEE 名古屋支部国際会議研究発表賞,IEEE 名古屋支部,吉永 透,2020年3月
- 学生研究奨励賞, 社団法人電子情報通信学会東海支部, 髙木雄介, 2019年6月.
- VDEC デザインアワード 優秀賞, 「耐放射線FPGA」,東京大学 大規模集積システム設計教育センター,藤森卓巳,2018年9月28日.
- 学生研究奨励賞, 社団法人電子情報通信学会東海支部, 榛葉大樹, 2018年6月.
- 学生研究奨励賞, 社団法人電子情報通信学会東海支部, 伊藤芳純, 2017年6月.
- 学生研究奨励賞, 社団法人電子情報通信学会東海支部, 赤部知也, 2016年6月.
- 学生研究奨励賞, 社団法人電子情報通信学会東海支部, 瀬尾真人, 2015年6月.
- 学生研究奨励賞, 社団法人電子情報通信学会東海支部, 藤森 卓巳, 2014年6月.
- 学生研究奨励賞, 社団法人電子情報通信学会東海支部, 上窪 勇貴, 2014年6月.
- 優秀卒業研究発表賞,電子情報通信学会 東海支部 卒業研究発表会,瀬尾真人,2014年3月.
- 学生研究奨励賞, 社団法人電子情報通信学会東海支部, 余座貴志, 2013年6月.
- 学生研究奨励賞, 社団法人電子情報通信学会東海支部, 伊藤宏幸, 2013年6月.
- 優秀ポスター賞,電子情報通信学会・総合大会「ISS特別企画・学生ポスターセッション」,山地勇一郎,2013年3月.
- 学生研究奨励賞, 社団法人電子情報通信学会東海支部, 山地勇一郎, 2012年6月.
- 学生奨励賞,情報処理学会・全国大会,渡辺貴弘,2012年3月.
- テレコムシステム技術学生賞,財団法人 電気通信普及財団,久保田 慎也,2012年3月.
- 社会人基礎力準大賞,社会人基礎力育成グランプリ2012決勝大会,日本経済新聞社(経済産業省),上野 由美子, 渡辺 貴弘,仁平優基,森脇烈,山地勇一郎,上窪勇貴,鳥飼勇希,余座貴志,青山裕司,渡邊 実,2012年2月.
- デザインガイヤポスター賞,デザインガイア(電子情報通信学会・情報処理学会),余座 貴志,2011年11月.
- 優秀賞,社会人基礎力育成グランプリ・関東地区大会,日本経済新聞社(経済産業省),上野 由美子,渡辺 貴弘, 仁平優基,森脇烈,山地勇一郎,上窪勇貴,鳥飼勇希,余座貴志,青山裕司,渡邊 実,2011年11月.
- 国際会議研究発表者賞,電子情報通信学会・東海支部,森脇 烈,2011年10月.
- SLDM研究会優秀発表学生賞,社団法人情報処理学会システムLSI設計技術研究会,森田 裕宣,2011年8月.
- 学生研究奨励賞, 社団法人電子情報通信学会東海支部, 森脇 烈, 2011年6月.
- テレコムシステム技術学生賞,財団法人 電気通信普及財団,間渕 隆之,2011年3月.
- 電気学会東海支部長賞,社団法人 電気学会東海支部, 渡邊 貴弘,2011年3月.
- 優秀卒業研究発表賞, 社団法人 電子情報通信学会東海支部, 渡邊 貴弘,2011年3月.
- 奨励賞,計測自動制御学会 中部支部, 間渕 隆之,2011年1月.
- 連合大会奨励賞,電気関係学会東海支部連合大会,間渕 隆之,2011年1月.
- 優秀賞,第8回情報学ワークショップ(WiNF2010), 森田 裕宣,2010年12月.
- 優秀学生顕彰 優秀賞,日本学生支援機構,渡邊 貴弘,2010年12月.
- SLDM研究会優秀発表学生賞, 社団法人情報処理学会システムLSI設計技術研究会, 久保田 慎也, 2010年9月.
- 学生研究奨励賞, 社団法人電子情報通信学会東海支部, 森田 裕宣, 2010年6月.
- 学生論文奨励賞,情報処理学会東海支部,瀬戸 大作,2010年5月.
- 奨励賞,計測自動制御学会 中部支部, 中島 真央,2010年1月.
- 連合大会奨励賞,電気関係学会東海支部連合大会,瀬戸 大作,2010年1月.
- IEEE学生奨励賞,電気関係学会東海支部連合大会,中島 真央,2010年1月.
- デザインガイアポスタ賞,デザインガイア,瀬戸 大作,2009年12月.
- デザインガイアポスタ賞,デザインガイア,中島 真央,2009年12月.
- 学生研究奨励賞, 社団法人電子情報通信学会東海支部, 中島 真央, 2009年6月.
- 学生研究奨励賞, 社団法人電子情報通信学会東海支部, 久保田 慎也, 2009年6月.
- IEEE Nagoya Section Excellent Student Award, IEEE Nagoya Section, S.
Kato, March, 2009. - 最優秀卒業研究発表賞, 社団法人電子情報通信学会東海支部, 加藤 進一, 2009年3月.
- 第133回SLDM研究会優秀発表学生賞, 社団法人情報処理学会システムLSI設計技術研究会, 瀬戸 大作, 2008年8月.
- 第133回SLDM研究会優秀発表学生賞, 社団法人情報処理学会システムLSI設計技術研究会, 中島 真央, 2008年8月.
- 学生研究奨励賞, 社団法人電子情報通信学会東海支部, 瀬戸 大作, 2008年6月.
- IEEE Nagoya Section Excellent Student Award, IEEE Nagoya Section, D. Seto, March, 2008.
- 計測自動制御学会九州支部奨励賞,「ダイナミック光再構成型ゲートアレイ」,深川,渡邊,小林,第11回計測自動制御学会九州支部講義会予稿, 103B-5, 2006.
- 計測自動制御学会九州支部奨励賞,「0.18umプロセスによる差分光再構成型ゲートアレイVLSI」,志岐,渡邊,小林,第24回計測自動制御学会九州支部学術講演会予稿,pp. 143-144,2005.
- 計測自動制御学会九州支部奨励賞,「位相補間によるPLLの特性改善」,井上,小林,渡邊,第24回計測自動制御学会九州支部学術講演会予稿,202A6,2005.
●学内の受賞
- 工学研究科長賞,静岡大学,瀬尾真人,2014年11月.
- 工学研究科長賞,静岡大学,赤木昂太,2014年11月.
- 工学研究科長賞,静岡大学,藤森卓巳,瀬尾真人,赤木昂太,2014年11月.
- 創造科学技術大学院長賞,静岡大学,森脇烈,2014年9月.
- 浜松工業会学習奨励賞, 浜松工業会,瀬尾真人, 2014年,3月
- 学長賞,静岡大学,森脇烈,余座貴志,鳥飼勇希,上窪勇貴,窪田貴之,藤森卓巳,伊藤宏幸,赤木昂太,瀬尾真人,2014年3月.
- 学長賞「国際会議ICFPT世界一」,静岡大学,森脇烈,余座貴志,上窪勇貴,鳥飼勇希,谷川彰,窪田貴之,伊藤宏幸,白橋侑弥,2013年3月.
- 学長賞「国際会議ICFPT世界一」,静岡大学,渡辺貴弘,森脇烈,山地勇一郎,上窪勇貴,鳥飼勇希,仁平優基,余座貴志,上野由美子,青山裕司,2012年3月.
- 学長賞「研究」,静岡大学,渡辺 貴弘,2012年3月.
- 学部長賞,静岡大学工学部,瀬戸 大作,2010年3月.
■国際会議論文
- Minoru Watanabe, Makoto Kobayashi, Mitsutaka Isobe, Kunihiro Ogawa, Shingo Tamaki, Isao Murata, Sachie Kusaka, “Fast-Neutron Soft-Error Tolerance of a Radiation-Hardened Repairable Field Programmable Gate Array”, IEEE International Conference on Consumer Electronics, Jun.,2025.
- Nobuya Watanabe, Minoru Watanabe, “Triple Modular Redundancy Logic Design from High-Level Hardware Description”, IEEE International Conference on Consumer Electronics, Jun.,2025.
- Naoki Nagamine, Minoru Watanabe, Nobuya Watanabe, “Development of a Radiation-Hardened JTAG Interface for Optically Reconfigurable Gate Arrays”, IEEE International Conference on Consumer Electronics, Jun.,2025.
- Utsuki Sekioka, Minoru Watanabe, Nobuya Watanabe, “Radiation-Hardened Triple Modular Redundant Serial Communication System Using Triple Communication Lines”, IEEE International Conference on Consumer Electronics, Jun.,2025.
- Atsushi Takata, Minoru Watanabe, Nobuya Watanabe, “Evaluation of a Wafer-Scale VLSI Using Programmable Architecture”, IEEE International Conference on Consumer Electronics, Jun.,2025.
- Atsushi Takata, Minoru Watanabe, Nobuya Watanabe, “REALIZATION OF A HUGE-SCALE RADIATION-HARDENED OPTICALLY RECONFIGURABLE GATE ARRAY VLSI” ,REALIZATION OF A HUGE-SCALE RADIATION-HARDENED OPTICALLY RECONFIGURABLE GATE ARRAY VLSI 1-4, Oct., 2024.
- Masato Isobe, Minoru Watanabe, Nobuya Watanabe, “TRIPPLE MODULAR REDUNDANT RISC-V PROCESSOR ON A CYCLONE FPGA”, International Topical Workshop on Fukushima-Daiichi Decommissioning Research 2024 1-4, Oct., 2024.
- Kiyoto Yonechi, Minoru Watanabe, Nobuya Watanabe, “OPTICALLY RECONFIGURED GATE ARRAY VLSI WITH A TRIPLE-MODULAR REDUNDANT OPTICAL CONFIGURATION CIRCUIT”, International Topical Workshop on Fukushima-Daiichi Decommissioning Research 2024 1-4, Oct., 2024.
- Soma Imai, Minoru Watanabe, Nobuya Watanabe, “IMPLEMENTATION OF A MONO INSTRUCTION SET COMPUTER ON A RADIATION-HARDENED OPTICALLY RECONFIGURABLE GATE ARRAY”, International Topical Workshop on Fukushima-Daiichi Decommissioning Research 2024 1-4, Oct., 2024.
- Ryota Hosoya, Minoru Watanabe, Nobuya Watanabe, “A 4-BIT COUNTER IMPLEMENTATION ON A REPAIRABLE FPGA”, International Topical Workshop on Fukushima-Daiichi Decommissioning Research 2024 1-4, Oct., 2024.
- Shintaro Takatsuki, Minoru Watanabe, Nobuya Watanabe, “A RING OSCILLATOR IMPLEMENTATION ONTO AN OPTICALLY RECONFIGURABLE GATE ARRAY VLSI” ,International Topical Workshop on Fukushima-Daiichi Decommissioning Research 2024 1-4, Oct., 2024.
- Ayumu Ogura, Minoru Watanabe, Nobuya Watanabe, “Clock distribution exploiting switching matrices on an optically reconfigurable gate array” ,International Topical Workshop on Fukushima-Daiichi Decommissioning Research 2024 1-4, Oct., 2024.
- Utsuki Sekioka, Minoru Watanabe, Nobuya Watanabe, “Triple modular redundant serial communication circuit used in a severe radiation environment” ,International Topical Workshop on Fukushima-Daiichi Decommissioning Research 2024 1-4, Oct., 2024.
- Akifumi Ogiwara, Minoru Watanabe, “Formation of holographic memory using laser combiner consisting of three laser sources with different wavelength for optical reconfiguration” ,International Symposium on Imaging, Sensing, and Optical Memory 2024 59-60, Oct., 2024.
- Shintaro Takatsuki, Minoru Watanabe, Nobuya Watanabe, “Ring oscillator based clock generation for a radiation-hardened optically reconfigurable gate array VLSI”, IEEE International System-on-Chip Conference 1-6, Sep.,2024.
- Minoru Watanabe, “Radiation-hardened programmable two-phase clock generator”,2024 International Electronics Symposium (IES) 140-144, Aug.,2024.
DOI:10.1109/ies63037.2024.10665801 - Masato Isobe, Minoru Watanabe, Nobuya Watanabe, “A triple modular redundant RISC-V processor on a Cyclone V FPGA”,RISC-V Day Tokyo 2024 Summer English 1-1, Aug.,2024.
- Takumi Fukumoto, Minoru Watanabe, Nobuya Watanabe, “Holographic memory optimization method for an Optically reconfigurable gate array”, E08-E08, Aug.,2024.
- Yuki Shimamura, Minoru Watanabe, Nobuya Watanabe,”Voltage Range Evaluation of An Optically Reconfigurable Gate Array VLSI”,2024 IEEE 35th International Conference on Application-specific Systems, Architectures and Processors (ASAP) 239-240, July, 2024.
DOI:10.1109/asap61560.2024.00055 - Minoru Watanabe, “Analysis of Clock Tree Buffer Degradation Caused by Radiation”, Lecture Notes in Computer Science 120-133, March, 2024.
DOI:10.1007/978-3-031-55673-9_9 - Minoru Watanabe, Makoto Kobayashi, Mitsutaka Isobe, Kunihiro Ogawa, Shigeo Matsuyama, Misako Miwa, “Fast-neutron soft-error tolerance experimentation with a radiation-hardened optically reconfigurable gate array”,2024 IEEE International Conference on Consumer Electronics (ICCE), Jun.,2024.
DOI:10.1109/icce59016.2024.10444280 - Atsushi Takata, Minoru Watanabe, Nobuya Watanabe, “Wafer-scale VLSI realization using programmable architecture”, 2024 IEEE International Conference on Consumer Electronics (ICCE), Jun.,2024.
DOI:10.1109/icce59016.2024.10444278 - Utsuki Sekioka, Minoru Watanabe, Nobuya Watanabe, “Remote monitoring system for optically reconfigurable gate arrays in radiation environments,” ICCE, Jun.,2024.
DOI:10.1109/ICCE59016.2024.10444276 - Akifumi Ogiwara, Minoru Watanabe, “Holographic Memory Formed by Different Laser Wavelengths in Laser Combiner System for Optically Reconfigurable Gate Array,” IEEE International Conference on Consumer Electronics, Jun.,2024.
- Nobuya Watanabe, Ryoya Ishitani, Minoru Watanabe, “Application Design System for High-Speed Dynamically Reconfigurable Gate Arrays,” Jun.,2024.
- Sae Goto, Minoru Watanabe, Akifumi Ogiwara, Nobuya Watanabe, “Parallel Configuration Experiment for a Radiation-Hardened Optically Reconfigurable Gate Array with a Holographic Polymer-Dispersed Liquid Crystal Memory, “International Conference on Consumer Electronics, Jun.,2024.
- Takato Tanizawa, Minoru Watanabe, “Radiation-hardened stabilized power supply unit based on bipolar transistors,” International Conference on Microelectronics, Dec.,2023.
DOI:10.1109/ICM60448.2023.10378903 - Masashi Tsujino, Minoru Watanabe, Nobuya Watanabe, “An optically reconfigurable gate array VLSI driven by an unstabilized power supply unit,” 2023 IEEE 36th International System-on-Chip Conference (SOCC), Sep.,2023.
DOI:10.1109/SOCC58585.2023.10257130 - Akifumi Ogiwara, Minoru Watanabe, “Construction of Laser Interferometer Consisting of Different Wavelengths Using Laser Combiner System for Fabrication of Holographic Memory for Optically Reconfigurable Gate Array,” Microoptics Conference (MOC), Sep.,2023.
- Masato Isobe, Minoru Watanabe, Nobuya Watanabe, “Design example of a triple modular redundancy ALU, a register file, and a program counter for a processor,” The seventh International Forum on the Decommissioning of the Fukushima Daiichi Nuclear Power Plant, Aug.,2023.
- Yuki Shimamura, Minoru Watanabe, Nobuya Watanabe, “Evaluation of low-voltage operations of an optically reconfigurable gate array VLSI,” The seventh International Forum on the Decommissioning of the Fukushima Daiichi Nuclear Power Plant, Aug.,2023.
- Sae Goto, Minoru Watanabe, Nobuya Watanabe, “Photodiode current range measurement result of an optically reconfigurable gate array VLSI,” The seventh International Forum on the Decommissioning of the Fukushima Daiichi Nuclear Power Plant, Aug.,2023.
- Utsuki Sekioka, Minoru Watanabe, Nobuya Watanabe, “Remote monitoring system used in a severe radiation environment,” The seventh International Forum on the Decommissioning of the Fukushima Daiichi Nuclear Power Plant, Aug.,2023.
- Shintaro Takatsuki, Minoru Watanabe, Nobuya Watanabe, “Sequential circuit implementation onto optically reconfigurable gate array VLSI using a ring oscillator,” The seventh International Forum on the Decommissioning of the Fukushima Daiichi Nuclear Power Plant, Aug.,2023.
- Atsushi Takata, Minoru Watanabe, Nobuya Watanabe, “Realization of a wafer-scale VLSI by using optically reconfigurable gate array architecture,” The seventh International Forum on the Decommissioning of the Fukushima Daiichi Nuclear Power Plant, Aug.,2023.
- Soma Imai, Minoru Watanabe, Nobuya Watanabe, “A mono instruction set computer architecture on an optically reconfigurable gate array VLSI,” The seventh International Forum on the Decommissioning of the Fukushima Daiichi Nuclear Power Plant, Aug.,2023.
- Kaho Yamada, Minoru Watanabe, Nobuya Watanabe, “Total-ionizing-dose tolerance of an optically reconfigurable gate array VLSI,” The seventh International Forum on the Decommissioning of the Fukushima Daiichi Nuclear Power Plant, Aug.,2023.
- Masashi Tsujino, Minoru Watanabe, Nobuya Watanabe, “An optically reconfigurable gate array driven by an unstabilized power supply unit,” The seventh International Forum on the Decommissioning of the Fukushima Daiichi Nuclear Power Plant, Aug.,2023.
- Kakeru Ando, Minoru Watanabe, Nobuya Watanabe, “Multi-context-scrubbing operation for a 1-bit counter circuit,” 2023 21st IEEE Interregional NEWCAS Conference (NEWCAS), 1-6 Jun.,2023.
DOI:10.1109/NEWCAS57931.2023.10198189 - Masato Isobe, Minoru Watanabe, Nobuya Watanabe, “Design example of a triple modular redundancy ALU and register-file for RISC-V processors,” RISC-V Days Tokyo 2023 Summer conference, Jun.,2023.
https://riscv.or.jp/wp-content/uploads/RISC-V - Minoru Watanabe, “Radiation-hardened triple-modular redundant field programmable gate array with a two-phase clock,” 2023 IEEE International Symposium on Circuits and Systems (ISCAS), 1-6 May.,2023.
DOI:10.1109/ISCAS46773.2023.10181472 - Sae Goto, Kakeru Ando, Kaho Yamada, Minoru Watanabe, Nobuya Watanabe, Makoto Kobayashi, Mitsutaka Isobe, Kunihiro Ogawa, Shingo Tamaki, Isao Murata, Sachie Kusaka, “Multi-context optically reconfigurable gate array system used for fast-neutron experiments,” 16TH IEEE DALLAS CIRCUITS AND SYSTEMS CONFERENCE -(-) 1-1 Apr.,2023.
- Daisuke Bamba, Minoru Watanabe, Nobuya Watanabe, “Total-Ionizing-Dose Tolerance Analysis of a Radiation-Hardened Image Sensor,” 2023 IEEE International Conference on Consumer Electronics (ICCE) -(-) 1-2 Jan.,2023.
DOI: 10.1109/ICCE56470.2023.10043521 - Sae Goto, Minoru Watanabe, and Nobuya Watanabe, “Optically reconfigurable gate array VLSI that can support a perfect parallel configuration,” 18th IEEE Asia Pacific Conference on Circuits and Systems, Shenzhen, China, Nov., 2022.
DOI: 10.1109/APCCAS55924.2022.10090314 - Kaho Yamada, Takeshi Okazaki, Minoru Watanabe, and Nobuya Watanabe, “Total Dose Tolerance Analysis of an Optically Reconfigurable Gate Array VLSI,” IEEE International Conference on Electronics Circuits and Systems, Glasgow, UK, Oct., 2022.
DOI: 10.1109/ICECS202256217.2022.9970905 - Minoru Watanabe, “Cf252 neutron soft error tolerance of an optoelectronic field programmable gate array VLSI,” IEEE International Integrated Reliability Workshop, Fallen Leaf Lake, USA, Oct., 2022.
DOI:10.1109/IIRW56459.2022.10032739 - Kaho Yamada, Takeshi Okazaki, Minoru Watanabe and Nobuya Watanabe, “Total-ionizing-dose tolerance of an optically reconfigurable gate array VLSI,” The sixth International Forum on the Decommissioning of the Fukushima Daiichi Nuclear Power Plant, Aug., 2022.
- Sae Goto, Minoru Watanabe and Nobuya Watanabe, “Optically reconfigurable gate array VLSI without any common signal,” The sixth International Forum on the Decommissioning of the Fukushima Daiichi Nuclear Power Plant, Aug., 2022.
- Minoru Watanabe, “Radiation-hardened optically reconfigurable gate array,” Global Summit and Expo on Nanotechnology and Nanomaterials (GSENN), Jun., 2022.
DOI:10.7567/JJAP.54.09MA06 - Akihiko Ushiroyama, Minoru Watanabe, Nobuya Watanabe, and Akira Nagoya, “Convolutional neural network implementations using Vitis AI,” IEEE Annual Computing and Communication Workshop and Conference, Las Vegas, USA, pp. 365-371, Jan., 2022.
DOI: 10.1109/CCWC54503.2022.9720794 - Hiroshi Ito, Minoru Watanabe, “Total-ionizing-dose tolerance evaluation of an optoelectronic field programmable gate array VLSI during operation,“
International Conference on Field-Programmable Technology, Dec., 2021.
DOI: 10.1109/ICFPT52863.2021.9609910 - Minoru Watanabe, ”Radiation Hardened Optically Reconfigurable Gate Array,”
OPTICSMEET2021,Nov., 2021.
DOI: 10.7567/JJAP.54.09MA06 - Junya Ishido, Minoru Watanabe, Akifumi Ogiwara, “Optically reconfigurable gate array with a 1 Grad total-ionizing-dose tolerant holographic memory,“
IEEE Photonics Conference (IPC), Oct., 2021.
DOI: 10.1109/IPC48725.2021.9592957 - Akifumi Ogiwara, Minoru Watanabe, “Holographic gratings formed by wavelength multiplexing in liquid crystal composites,“
26th Microoptics Conference (MOC), Sep., 2021.
DOI: 10.23919/MOC52031.2021.9598095 - Kurea Murakami, Minoru Watanabe, “Sequential Circuit Implementation Method for Multi-Context Scrubbing Operations on FPGAs,”
IEEE International Symposium on Circuits and Systems, pp. ***-***, May, 2021.
DOI: 10.1109/ISCAS51556.2021.9401291 - Junya Ishido, Minoru Watanabe, “Multi-context holographic memory exploiting a wavelength-dependent optimization technique,“
IEEE International Conference on Photonics, May, 2020.
DOI: 10.1109/ICP46580.2020.9206463 - Yuichi Moriya, Minoru Watanabe, “Radiation tolerance of a crystal oscillator circuit,”
The 6th International Symposium toward the Future of Advanced Researches in Shizuoka University, Shizuoka University, March, 2020.
https://confit.atlas.jp/guide/event-img/aesj2019f/3K10/public/pdf?type=in - Md Roman Ahmed, Minoru Watanabe, “Implementation of RISC-V Processor on MAX-10 FPGA,”
The 6th International Symposium toward the Future of Advanced Researches in Shizuoka University, Shizuoka University, March, 2020. - Yuki Takena, Minoru Watanabe, “Place and route tool for optically reconfigurable gate arrays with fault cells,”
The 6th International Symposium toward the Future of Advanced Researches in Shizuoka University, Shizuoka University, March, 2020. - Junya Ishido, Minoru Watanabe, “Radiation-hardened optically reconfigurable gate array using a multi-wavelength holographic memory,”
IEEE Workshop on Silicon Errors in Logic – System Effects, pp. ***-***, Stanford University, CA, USA, Feb., 2020. - Makishi Toda, Akifumi, Ogiwara, Minoru Watanabe, “Effect of radiation dose of Gamma-Ray irradiation on volume gratings using liquid crystal composites,”
Microoptics Conference, pp. 238-239, Toyama, Japan, Nov., 2019.
DOI: 10.23919/MOC46630.2019.8982829 - Masaki Watanabe, Minoru Watanabe, “Full-hardware triple modular and penta-modular redundancies using a high frequency majority voting operation,”
IEEE Asia Pacific Conference on Circuits and Systems, Bangkok, Tailand, Nov., 2019.
DOI: 10.1109/APCCAS47518.2019.8953122 - Hirotoshi Ito, Minoru Watanabe, “Parallel-operation-oriented optically reconfigurable gate array VLSI,”
IEEE International Conference on Space Optical Systems and Applications, Portland, USA, Oct., 2019. - Hirotoshi Ito, Minoru Watanabe, “Radiation-degradation Analysis and a Circuit Performance Improvement Method for Optoelectronic Field Programmable Gate Array,“
IEEE International System-on-Chip Conference, Sep., 2019.
DOI: 10.1109/SOCC46988.2019.1570548505 - Yusuke Takaki, Kohei Nagasu, Shin Abiko, Minoru Watanabe, Kentaro Sano, “FPGA implementation of a robot control algorithm,”
International Conference on Emerging Technologies and Factory Automation, Zaragoza, Spain, Sep., 2019.
DOI: 10.1109/ETFA.2019.8869217 - Hirotoshi Ito, Minoru Watanabe, “Total-ionizing-dose degradation analysis of an optoelectronic field programmable gate array,
IEEE International System-on-Chip Conference, Singapore, Sep., 2019. - Toru Yoshinaga, Minoru Watanabe, “Optically Reconfigurable Gate Array with a triple modular redundancy,”
International Conference on Space Science and Communication, Johor, Malaysia, July, 2019.
DOI: 10.1109/IconSpace.2019.8905937 - Takumi Fujimori, Minoru Watanabe, “A 1.15 Grad total-ionizing-dose tolerance parallel operation oriented optically reconfigurable gate array VLSI,”
IEEE International Workshop on Metrology for AeroSpace, Torino, Italy, June, 2019. - Shinya Fujisaki, Takumi Fujimori, Minoru Watanabe,
“An optically reconfigurable gate array workable under a strong gamma radiation environment ,”
IEEE- Workshop on Microelectronics and Electron Devices, Boise State University, USA, April, 2019.
DOI: 10.1109/WMED.2019.8714154 (IEEE Xplore) - M. Watanabe, “1 Grad radiation-hardened optoelectronic embedded system,”
IEEE Workshop on Silicon Errors in Logic – System Effects, Stanford, California, USA, March, 2019. - T. Fujimori, M. Watanabe, “Soft-error tolerance of an optically reconfigurable gate array VLSI,”
INTERNATIONAL CONFERENCE ON SYSTEMS ENGINEERING, pp. 1-6, Sydney, Australia, Dec., 2018.
DOI: 10.1109/ICSENG.2018.8638203 (IEEE Xplore) - M. Watanabe, “Radiation-hardened optically reconfigurable gate array,” Fukushima Research Conference “Radiation Hardness and Smartness in Remote Technology for Nuclear Decommissioning”, Fukushima, Japan, Nov., 2018.
- T. Hatamochi, M. Watanabe, “Radiation-hardened motor controller,” Fukushima Research Conference “Radiation Hardness and Smartness in Remote Technology for Nuclear Decommissioning”, Fukushima, Japan, Nov., 2018.
- T. Yoshinaga, M. Watanabe, “Triple modular redundancy optically reconfigurable gate array,” Fukushima Research Conference “Radiation Hardness and Smartness in Remote Technology for Nuclear Decommissioning”, Fukushima, Japan, Nov., 2018.
- Y. Takaki, M. Watanabe, K. Sano, “Full-hardware robot controller,” Fukushima Research Conference “Radiation Hardness and Smartness in Remote Technology for Nuclear Decommissioning”, Fukushima, Japan, Nov., 2018.
- Masaki Watanabe, Minoru Watanabe, “Many modular redundancy implementation on CPLD,” Fukushima Research Conference “Radiation Hardness and Smartness in Remote Technology for Nuclear Decommissioning”, Fukushima, Japan, Nov., 2018.
- Shinya Fujisaki, Minoru Watanabe, “Radiation-hardened power supply unit,” Fukushima Research Conference “Radiation Hardness and Smartness in Remote Technology for Nuclear Decommissioning”, Fukushima, Japan, Nov., 2018.
- Y. Takaki, M. Watanabe, “An optically reconfigurable gate array using four liquid crystal spatial light modulators,”
IEEE CPMT Symposium Japan, pp. 185 – 188, Kyoto Univ., Nov., 2018.
DOI: 10.1109/ICSJ.2018.8602907 (IEEE Xplore) - T. Fujimori, M. Watanabe, “Total-Ionizing-Dose Tolerance of the configuration function of MAX3000A CPLDs,”
Data Workshop, pp. ***-***, Göteborg, Sweden, Sep., 2018.
DOI 10.1109/RADECS45761.2018.9328682 - S. Fujisaki, M. Watanabe, “Radiation-hardened stabilized power supply unit based on a lnthiumion battery,”
Radiation and its Effects on Components and Systems conference, pp. ***-***, Göteborg, Sweden, Sep., 2018.
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“272 gate count optically differential reconfigurable gate array VLSI,”
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“Optimization of reconfiguration speed control bits for an Optically Reconfigurable Gate Array,”
International Conference on engineering of reconfigurable systems and algorithms, CD-ROM, July, 2007. - M. Watanabe, F. Kobayashi,
“Holographic memory reconfigurable VLSI,”
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“Power Consumption Reduction Method of Dynamic Optically Reconfigurable Gate Array VLSIs,”
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“A multi-context holographic memory recording system for Optically Reconfigurable Gate Arrays,”
IEEE International Parallel & Distributed Processing Symposium, CD-ROM, March, 2007.
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“Superimposing technique of reconfiguration contexts,”
ACM/SIGDA International Symposium on Field Programmable Gate Arrays, pp. 227-228, Monterey, USA, Feb., 2007. - M. Watanabe, F. Kobayashi,
“Superimposing technique of reconfiguration contexts for increasing reconfiguration speed,”
Mobile Computing Hardware Architectures Design Symposium, WEB, Hawaii, USA, Jan., 2007. - M. Watanabe, F. Kobayashi,
“A 0.35um CMOS 1,632-gate-count Zero-Overhead Dynamic Optically Reconfigurable Gate Array VLSI,”
Asia and South Pacific Design Automation Conference, pp.124-125, Yokohama, Japan, Jan., 2007.
DOI: 10.1109/ASPDAC.2007.357972 (IEEE Xplore) - M. Inoue, F. Kobayashi, M. Watanabe,
“Over-Sampling PLL for Low-Jitter and Responsive Clock Synchronization,”
IEEE International Symposium on Communications and Information Technologies, CD-ROM, Bangkok, Thailand, 2006.
DOI: 10.1109/ISCIT.2006.339842 (IEEE Xplore) - M. Watanabe, F. Kobayashi,
“Optically Reconfigurable Gate Arrays vs.ASICs,”
IEEE Asia Pacific Conference on Circuits and Systems, pp.1166-1169, Grand Copthorne Waterfront, Singapore, Dec., 2006.
DOI: 10.1109/APCCAS.2006.342348 (IEEE Xplore) - M. Watanabe, F. Kobayashi,
“A reconfiguration speed adjustment technique for ORGAs with a holographic memory,”
International Conference on Field Programmable Logic and Applications, pp. 917-922, Madrid, Spain, Aug., 2006.
DOI: 10.1109/FPL.2006.311344 (IEEE Xplore) - M. Watanabe, R. Fujime, F. Kobayashi,
“A dynamic differential reconfiguration circuit for optically differential reconfigurable gate arrays,”
IEEE International Midwest Symposium on Circuits and Systems, CD-ROM, San Juan, Puerto Rico, Aug., 2006.
DOI: 10.1109/MWSCAS.2006.382216 (IEEE Xplore) - M. Watanabe, M. Miyano, F. Kobayashi,
“Differential Reconfiguration Architecture suitable for a Holographic Memory,”
International Conference on engineering of reconfigurable systems and algorithms, pp. 198-203, Las Vegas, USA, June, 2006. - M. Watanabe, F. Kobayashi,
“Shield effect analysis for a gate array on an Optically Reconfigurable Gate Array,”
International Conference on engineering of reconfigurable systems and algorithms, pp. 239-240, Las Vegas, USA, June, 2006. - M. Watanabe, F. Kobayashi,
“A logic synthesis and place and route environment for ORGAs,”
International Conference on engineering of reconfigurable systems and algorithms, pp.237-238, Las Vegas, USA, June, 2006. - M. Inoue, F. Kobayashi, M. Watanabe,
“Hybrid Sample Rate Converter with 110dB SNR and 1/10 Less Logic Gates,”
IEEE International Conference on Electro / Information Technology, pp. 432-436, East Lansing, USA, May, 2006.
DOI: 10.1109/EIT.2006.252121 (IEEE Xplore) - M. Watanabe, F. Kobayashi,
“Power consumption advantage of a dynamic optically reconfigurable gate array,”
IEEE International parallel & Distributed Processing Symposium, CD-ROM, Rhodes Island, Greece, April, 2006.
DOI: 10.1109/IPDPS.2006.1639490 (IEEE Xplore) - M. Watanabe, M. Miyano, F. Kobayashi,
“An optically differential reconfigurable gate array with a holographic memory,”
IEEE International parallel & Distributed Processing Symposium, CD-ROM, Rhodes Island, Greece, April, 2006.
DOI: 10.1109/IPDPS.2006.1639478 (IEEE Xplore) - M. Watanabe, F. Kobayashi,
“A 1,632 gate-count zero-overhead Dynamic Optically Reconfigurable Gate Array VLSI,”
International Workshop on Applied Reconfigurable Computing, Lecture Notes in Computer Science, Vol. 3985, pp. 268-273, Delft, Netherland, March, 2006.
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“A 476-gate-count Dynamic Optically Reconfigurable Gate Array VLSI chip in a standard 0.35um CMOS Technology,”
Asia and South Pacific Design Automation Conference, pp. 108-109, Yokohama, Japan, Jan., 2006. - M. Watanabe, F. Kobayashi,
“A zero-overhead Dynamic Optically Reconfigurable Gate Array,”
IEEE International Conference on Field-Programmable Technology, pp. 297-298, Singapore, Dec., 2005.
DOI: 10.1109/FPT.2005.1568569 - M. Miyano, M. Watanabe, F. Kobayashi,
“Rapid Reconfiguration of an Optically Differential Reconfigurable Gate Array with Pulse Lasers,”
IEEE International Conference on Field-Programmable Technology, pp. 287-288, Singapore, Dec., 2005.
DOI: 10.1109/FPT.2005.1568564 (IEEE Xplore) - M. Watanabe, F. Kobayashi,
“A 51,272-gate-count Dynamic Optically Reconfigurable Gate Array in a standard 0.35um CMOS Technology,”
International Conference on Solid State Devices and Materials, pp. 336-337, Kobe, Japan, Sep., 2005. - M. Inoue, F. Kobayashi, M. Watanabe,
“Fourier/Filter Hybrid Sampling Rate Converter,”
SICE Annual Conference, pp 176-179, Okayama, Japan, Aug., 2005. - M. Watanabe, F. Kobayashi,
“A 16,000-gate-count Optically Reconfigurable Gate Array in a standard 0.35um CMOS Technology,”
IEEE International Symposium on Circuits and Systems, pp. 1214-1217, Kobe, Japan, May, 2005.
DOI: 10.1109/ISCAS.2005.1464812 (IEEE Xplore) - M. Watanabe, F. Kobayashi,
“An improved dynamic optically reconfigurable gate array,”
IEEE Computer Society Annual Symposium on VLSI, pp. 136-141, Tampa, USA, May, 2005.
DOI: 10.1109/ISVLSI.2005.16 (IEEE Xplore) - M. Miyano, M. Watanabe, F. Kobayashi,
“Optically Differential Reconfigurable Gate Array using an optical system with VCSELs,”
IEEE Computer Society Annual Symposium on VLSI, pp. 274-275, Tampa, USA, May, 2005.
DOI: 10.1109/ISVLSI.2005.54 (IEEE Xplore) - M. Watanabe, F. Kobayashi,
“An Optically Differential Reconfigurable Gate Array VLSI chip with a dynamic reconfiguration circuit,”
IEEE International parallel & Distributed Processing Symposium, CDROM, Denver, USA, April, 2005.
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“Configuration for an Optically Differential Reconfigurable Gate Array,”
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“An Optically Differential Reconfigurable Gate Array with a dynamic reconfiguration circuit,”
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“A Compressed Implementation of Neural Network with Finite Physical Quantities on FPGAs,”
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“Motion Image Compression Circuit using the Silicon Retina as Active Sensor,”
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DOI: 10.1109/SICE.2002.1196605 (IEEE Xplore) - M. Watanabe, A. Itoh, F. Kobayashi ,
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■国内発表
- 永峰直樹, 渡邊 実, 渡邊誠也,「耐放射線プログラマブルデバイス向けJTAG」,第68回宇宙科学技術連合講演会, 11月,2024.
- 島村侑希, 渡邊 実, 渡邊誠也,「耐放射線光再構成型ゲートアレイのバッテリー駆動に向けた性能評価」,第68回宇宙科学技術連合講演会, 11月,2024.
- 小倉歩武, 渡邊 実, 渡邊誠也,「光再構成型ゲートアレイVLSIにおけるスイッチングマトリクスを利用したクロック分配法」,電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),8月,2024.
- 細谷亮太, 渡邊 実, 渡邊誠也,「リペアラブル耐放射線FPGAへの回路実装」,電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),8月,2024.
- 辻野 将, 渡邊 実, 渡邊誠也, 「脈流電圧で動作可能な光再構成型ゲートアレイ」,情報フォトニクス研究討論会, 7月,2024.
- DING HAITAO, 渡邊 実, 渡邊 誠也,「FPGAに実装する耐放射性AI」,第9回次世代次世代イニシアティブ廃炉技術カンファレンス, 3月,2024.
- 荻原 昭文, 渡邊 実, 「異なるレーザ波長を用いたレーザ干渉露光光学系の構築による液晶・高分子複合体材料へのホログラフィックメモリ作製」,応用物理学会春季学術講演会, 3月,2024.
- 米地巨豊, 渡邊 実, 渡邊誠也, 「光再構成型ゲートアレイの三重構成回路の実証」,情報処理学会 第86回全国大会, 3月,2024.
- 高田睦士, 渡邊 実, 渡邊 誠也, 「光再構成アーキテクチャを用いたウエハースケールVLSIの実現性」,電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会), 11月, 2023.
- 後藤彩絵, 渡邊 実, 荻原昭文, 渡邊誠也, 「液晶ホログラフィックメモリを持つ耐放射線光再構成型ゲートアレイへの並列構成試験」,電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),11月, 2023.
- 今井颯真, 渡邊 実, 渡邊誠也,「MISCプロセッサの光再構成型ゲートアレイVLSIへの実装と最大動作周波数評価」,電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),11月, 2023.
- 山田 果歩, 渡邊 実, 渡邊 誠也,「光再構成型ゲートアレイVLSIのγ線による放射線劣化特性の評価」,第67回宇宙科学技術連合講演会 ,10月, 2023.
- 関岡空己, 渡邊 実, 渡邊誠也,「光再構成型ゲートアレイの放射線試験向けモニタリングシステム」,電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),9月, 2023.
- 高月信太朗, 渡邊 実, 渡邊誠也,「水晶発振器を用いない光再構成型ゲートアレイへの順序回路の実装」,電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),9月, 2023.
- 島村侑希, 渡邊 実, 渡邊誠也,「光再構成型ゲートアレイの低電圧動作評価」,電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),6月, 2023.
- 辻野 将, 渡邊 実, 渡邊誠也,「脈流電源を用いた光再構成型ゲートアレイ」,情報処理学会第85回全国大会, 3月, 2023.
- 安藤 駆, 渡邊 実, 渡邊誠也,「マルチコンテキストスクラビングによる順序回路実装」,情報処理学会第85回全国大会, 3月, 2023.
- 荻原昭文, 渡邊 実,「液晶・高分子材料への波長多重記録によるホログラフィックメモリの作成」,第70回応用物理学会春季学術講演会, 3月, 2023.
- 安藤 駆, 渡邊 実, 渡邊 誠也,「宇宙機器向けマルチコンテキストスクラビング」,第66回宇宙科学技術連合講演会,熊本城ホール,11月2日,2022.
- 番場 大輔, 渡邊 実, 渡邊 誠也,「耐放射線イメージセンサのトータルドーズ耐性」第66回宇宙科学技術連合講演会,熊本城ホール,11月2日,2022.
- 渡邊 実, パネルタイトル「FPGAデザインコンテスト」,パネルディスカッション 「自律型モビリティシステムとドメイン特化型ハードウェアやFPGA技術の未来」,電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),9月7日, 2022.
- 後藤 彩絵,渡邊 実,渡邊 誠也,「完全並列構成が可能な光再構成型ゲートアレイVLSI」,電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),筑波大学,6月7日,2022.
- 山田 果歩,岡崎 武志,渡邊 実,渡邊 誠也,「光再構成型ゲートアレイVLSIの290 Mradまでのトータルドーズ耐性試験」,電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),筑波大学,6月7日,2022.
- 尾崎 洸人, 渡邊 誠也, 名古屋 彰, 渡邊 実, 「FSLによる3値化CNNのFPGA実装」 ,
パルテノン研究会,オンライン開催,12月25日,2021. - 後山 晃彦, 渡邊 誠也, 名古屋 彰, 渡邊 実,「Vitis AIを用いたCNN実装」,
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),9月10日,2021. - 渡邊実,「光再構成型ゲートアレイのスクラビング処理」,
静岡大学と核融合科学研究所との連携研究会,Zoom,12月15日,2020. - 守屋 佑一,渡邊 実,「レーザのトータルドーズ耐性試験」,
第64回宇宙科学技術連合講演会,WEB開催,10月28日,2020. - 喜夛本凌平,渡邊 実,「耐放射線光再構成型ゲートアレイのイメージセンサ応用」,
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),慶應義塾大学,1月24日,2020. - 髙木雄介,渡邊 実,「光再構成型ゲートアレイのマルチコンテキストスクラビングの耐放射線試験」,
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),慶應義塾大学,1月24日,2020. - 渡邊 将己,渡邊 実,「多重化回路実装におけるソフトエラー耐性評価」,第63回宇宙科学技術連合講演会,アスティとくしま,11月7日,2019.
- 伊藤 嘉俊,渡邊 実,「並列処理指向型光再構成型ゲートアレイVLSIにおける回路実装」,第63回宇宙科学技術連合講演会,アスティとくしま,11月7日,2019.
- 髙木雄介,渡邊 実,「マルチコンテキスト高速スクラビング」,第63回宇宙科学技術連合講演会,アスティとくしま,11月6日,2019.
- 石堂 順也,渡邊 実,「光再構成型ゲートアレイのマルチコンテキスト色構成」,第80回応用物理学会秋季学術講演会,北海道大学札幌キャンパス,9月21日,2019.
- 渡邊 将己,旗持 卓美,渡邊 実,「水晶振動子を用いた発振回路の放射線耐性」,日本原子力学会 2019年秋の大会,富山大学五福キャンパス,9月13日,2019.
- 吉永 透,渡邊 実,「三重実装が可能な光再構成型ゲートアレイVLSI」,日本原子力学会 2019年秋の大会,富山大学五福キャンパス,9月13日,2019.
- 伊藤 嘉俊,渡邊 実,「光再構成型ゲートアレイVLSIの放射線による特性劣化の評価」,2019年電子情報通信学会ソサイエティ大会,大阪大学豊中キャンパス,9月11日,2019.
- 吉永 透,渡邊 実,「3重実装・光再構成型ゲートアレイVLSI」, 電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),pp. **-**,サテライトキャンパスひろしま,12月6日,2018.
- 髙木雄介,渡邊 実,佐野健太郎,「ロボット制御アルゴリズムのFPGAへの実装」,電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),pp. **-**,サテライトキャンパスひろしま,12月6日,2018.
- 藤森 卓巳,渡邊 実,「光再構成型ゲートアレイVLSIの放射線劣化特性評価」,第63回宇宙科学技術連合講演会,久留米シティープラザ,10月,2018.
- 渡邊 将己,渡邊 実,「多重化回路実装におけるソフトエラー耐性の評価」,第63回宇宙科学技術連合講演会,久留米シティープラザ,10月,2018.
- 高木 雄介,渡邊 実,「光再構成型ゲートアレイにおける動的再構成」,第63回宇宙科学技術連合講演会,久留米シティープラザ,10月,2018.
- 藤崎 伸也,渡邊 実,「超音波センサの耐放射線性能評価」, 第63回宇宙科学技術連合講演会,久留米シティープラザ,10月,2018.
- 渡邊 実,「FPGAによる自動車の自動走行コンテストについて」,第4回 人工知能とHW/SW協調設計ワークショップ,てんぶす那覇,7月,2018.
- 杉山 和礼,渡邊 実,「光再構成型ゲートアレイの光バスにおけるビットエラーレートの測定」,電子情報通信学会総合大会,学生ポスターセッション,東京電機大学,3月,2018.
- 藤崎伸也,渡邊 実,「超音波センサの放射線耐性試験」,電子情報通信学会総合大会,A-4-5,東京電機大学,3月21日,2018.
- 藤森卓巳,渡邊 実,「光再構成型ゲートアレイVLSIの放射線耐性評価」,電子情報通信学会総合大会,D-10-3,東京電機大学,3月22日,2018.
- 旗持卓美,渡邊 実,「放射線環境でのモータ制御」,電子情報通信学会総合大会,A-1-24,東京電機大学,3月23日,2018.
- 森卓巳,渡邊 実,「光再構成型ゲートアレイのトータルドーズ耐性」 ,電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),pp. **-**,慶応義塾大学,1月19日,2018.
- 藤森卓巳,渡邊実,「宇宙機器向けホログラムメモリ計算のアクセラレーション」,
第61回宇宙科学技術連合講演会,pp. ***-***,10月25日〜27日. - 藤森卓巳,渡邊 実,「光再構成型ゲートアレイのホログラムメモリ計算のハードウェアアクセラレーション」 ,
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),pp. 31-36,(株) ドワンゴ,9月25日,2017. - 榛葉大樹,渡邊 実,「VTRを使用したMono Instruction Set Computer の性能解析」 ,
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),pp. 43-46,(株) ドワンゴ,9月25日,2017. - 伊藤芳純,渡邊 実,荻原昭文,「光再構成型ゲートアレイのホログラムメモリ部の耐放射線性能試験」,
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),pp. 43-46,登別温泉第一滝本館,5月22日,2017. - 藤﨑伸也,渡邊 実,「光再構成型ゲートアレイ向け耐放射線安定化電源」,
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),pp. 47-50,登別温泉第一滝本館,5月22日,2017. - 藤森卓巳,渡邊 実,「マルチコンテキストを用いた高速光スクラビング」,
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),pp. 105-109,登別温泉第一滝本館,5月22日,2017. - Bharat Ramanathan, Minoru Watanabe, “Photodiode Response Measurement Technique using Low Laser Intensity,”
電子情報通信学会総合大会,3月,2017. - 榛葉大樹,渡邊実,「マルチコンテキスト光再構成型ゲートアレイの暗点雑音測定」,
電子情報通信学会総合大会,3月,2017. - 寺田涼,渡邊実,「ハードウェアアクセラレータの放射線耐性」,
電子情報通信学会総合大会,3月,2017. - 伊藤芳純,渡邊実,荻原 昭文,「ホログラムメモリの放射線耐性評価」,
電子情報通信学会総合大会,3月,2017. - 旗持卓美,渡邊 実,「モータコントローラの放射線耐性試験」,
電子情報通信学会総合大会,p. A-1-4,名城大学,3月23日,2017. - 藤﨑伸也,渡邊 実,「電源回路の放射線耐性試験」,
電子情報通信学会総合大会,p. C-12-13,名城大学,3月24日,2017. - 藤森卓巳,渡邊 実,「光再構成型ゲートアレイの高速スクラビング手法」,
電子情報通信学会総合大会,p. D-6-16,名城大学,3月22日,2017. - 荻原 昭文,渡邊 実,伊藤 芳純,「液晶ホログラムメモリへの放射線照射による光学特性の影響」,
第64回応用物理学会春季学術講演会,p. 17a-P1-2,パシフィコ横浜,3月17日,2017. - 赤部知也,渡邊実,「レーザアレイの放射線耐性評価」,
第15回情報科学技術フォーラム(FIT2016),pp. 263-264, 富山大学,9月9日,2016. - 伊藤芳純・渡邊実,荻原昭文,「ホログラムメモリの放射線耐性試験」,
第15回情報科学技術フォーラム(FIT2016),pp. 265-266, 富山大学,9月9日,2016. - 榛葉大樹,古川晋也,Ili Shairah Abdul Halim,渡邊 実,小林史典,「光再構成型ゲートアレイの光入力」,
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),pp. 67-70,富士通研究所 岡田記念ホール,5月19日,2016. - 前田雄大,荻原昭文,渡邊 実,「液晶ホログラムメモリへの角度多重記録におけるレーザ露光条件の改善」,
第63回応用物理学会春季学術講演会,p. 22a-P3-3,3月,2016. - 榛葉大樹,渡邊 実,「光再構成型ゲートアレイの反転コンフィギュレーション手法のフォールトトレランス評価」,
デザインガイア2015 -VLSI設計の新しい大地,長崎県勤労福祉会館,pp. 5-8,12月,2015. - 伊藤芳純,渡邊 実,「並列処理指向・光再構成型ゲートアレイへのTMR実装」,
デザインガイア2015 -VLSI設計の新しい大地,長崎県勤労福祉会館,pp. 1-4,12月,2015. - 赤部知也,渡邊 実,「放射線でダメージを受けた光再構成型ゲートアレイのリカバリー手法」,
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),pp. 59-62, 愛媛大学,9月19日,2015 - 藤森卓巳,渡邊 実,「光再構成型ゲートアレイの高速スクラビング」,
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),pp. 131-134,京都大学,6月20日,2015 - 藤森卓巳,渡邊 実,「並列処理指向型FPGAアーキテクチャ」,
再生可能集積システム時限研究会,pp. 67-70,明治大学,4月17日,2015. - 藤森卓巳,渡邊 実,「2 並列ゲートアレイをもつ並列処理指向型光再構成型ゲートアレイVLSI」,
電子情報通信学会・総合大会・ISS特別企画学生ポスターセッション,立命館大学,3月12日,2015. - 赤木 昂太,渡邊 実,「光再構成型ゲートアレイにおけるレーザアレイに対する放射線耐性」,
日本光学会 情報フォトニクス研究グループ・関東学生研究論文講演会,p. 45,静岡大学,3月10日,2015. - 藤森 卓巳,渡邊 実,「MEMSホログラムメモリの放射線耐性」,
日本光学会 情報フォトニクス研究グループ・関東学生研究論文講演会,p. 44,静岡大学,3月10日,2015. - 窪田 貴之,渡邊 実,「光再構成型ゲートアレイのホログラムメモリの放射線耐性」,
日本光学会 情報フォトニクス研究グループ・関東学生研究論文講演会,p. 1,静岡大学,3月10日,2015. - 伊藤宏幸,森脇 烈,渡邊 実,「光再構成型ゲートアレイの並列構成法の放射線耐性に関する一考察」,
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),pp. 31-34, 慶応大学,1月29日,2015. - 藤森卓巳、渡邊実、「光再構成型ゲートアレイの色構成手法の放射線耐性」,
宇宙科学技術連合講演会,長崎ブリックホール,11月14日,2014. - 藤森卓巳、渡邊実、「光再構成型ゲートアレイの4色カラー構成」,
再生可能集積システム時限研究会,東洋大学,10月18日,2014. - 藤森卓巳,渡邊 実,「並列処理指向・光再構成型ゲートアレイVLSI」,
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),pp. 47-50,杜の宿(宮島) ,9月18日,2014. - 森脇烈,伊藤宏幸,前川輝,渡邊実,荻原昭文,「光再構成型ゲートアレイのホログラムメモリ部の放射線耐性」,
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),pp. 19-22,杜の宿(宮島) ,9月18日,2014. - 窪田 貴之,渡邊 実,「高密度ダイナミック光再構成型ゲートアレイ」
電子情報通信学会 総合大会 ISS特別企画「学生ポスターセッション」,新潟大学,3月20日,2014. - 藤森卓巳,渡邊 実,「色構成手法を用いた光再構成型ゲートアレイの放射線耐性」
電子情報通信学会 総合大会 ISS特別企画「学生ポスターセッション」,新潟大学,3月20日,2014. - 荻原昭文,前川 輝,渡邊 実,森脇 烈,「角度多重記録による液晶ホログラムメモリを用いた光再構成試験」
第61回応用物理学会春季学術講演会,青山学院大学,3月18日,2014. - 赤木昂太,渡邊 実,「光再構成型ゲートアレイへの可変サイズスポット構成手法」,
平成25年度 電子情報通信学会東海支部 卒業研究発表会,三重大学,3月10日,2014. - 藤森卓巳,渡邊 実,「光再構成型ゲートアレイへの色構成手法」,
平成25年度 電子情報通信学会東海支部 卒業研究発表会,三重大学,3月10日,2014. - 瀬尾真人,渡邊 実,「差分光再構成型ゲートアレイの放射線耐性向上手法」,
平成25年度 電子情報通信学会東海支部 卒業研究発表会,三重大学,3月10日,2014. - 森脇烈,渡邊実,「負論理回路実装を活用した光再構成型ゲートアレイの放射線耐性の向上手法」
宇宙科学技術連合講演会,米子コンベンションセンター,10月9日,2013. - 瀬尾真人,渡邊 実,「差分光再構成型ゲートアレイの放射線耐性向上実装手法」
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会)
Vol. 113,No. 325,pp. 83-86,鹿児島県文化センター(宝山ホール),11月28日,2013. - 上窪勇貴,渡邊実,川人祥二,「フーリエ変換を用いた光再構成型ビジョンチップによる画像認識」
電気関係学会 東海支部連合大会,pp. **-**, 静岡大学,9月24日,2013. - 藤森卓巳,渡邊 実,「光再構成型ゲートアレイへの色構成手法」,
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会)
Vol. 113,No. 221,pp. 103-108,北陸先端科学技術大学院大学,9月19日,2013. - 赤木昂太,渡邊 実,「光再構成型ゲートアレイへの可変サイズスポット構成手法」
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会)
Vol. 113,No. 221,pp. 109-112,北陸先端科学技術大学院大学,9月19日,2013. - 前川 輝,荻原昭文,渡邊 実,森脇 烈,「光再構成用コンテキストデータの液晶ホログラムへの角度多重記録」,
応用物理学会秋季学術講演会,p.*,同志社大学,9月,2013. - 荻原 昭文,志智 弘,渡邊実,森脇 烈,「光再構成型ゲートアレイ用液晶ホログラムメモリの温度依存性」,
応用物理学会春季学術講演会,p. *, 神奈川工科大学,3月,2013. - 山地勇一郎,渡邊実,「4コンテキストMEMS光再構成型ゲートアレイ」,
電子情報通信学会 総合大会 ISS特別企画「学生ポスターセッション」,pp. **-**, 岐阜大学,3月,2013. - 谷川彰,渡邊実,「16コンテキストを活用した光再構成型ゲートアレイの放射線耐性の向上方法」,
電子情報通信学会 総合大会 ISS特別企画「学生ポスターセッション」,pp. **-**, 岐阜大学,3月,2013. - 白橋侑弥,渡邊実,「MISCディペンダブルシステムのStratix V FPGAへの実装」,
電子情報通信学会 総合大会 ISS特別企画「学生ポスターセッション」,pp. **-**, 岐阜大学,3月,2013. - 山地勇一郎,渡邊実,「2コンテキストMEMS光再構成型ゲートアレイ」,
電子情報通信学会 総合大会,pp. **-**, 岐阜大学,3月,2013. - 伊藤宏幸,渡邊実,「モノ・インストラクション・セット・コンピュータの実装」,
卒業研究発表会,電子情報通信学会 東海支部,pp. **-**, 名古屋大学,3月,2013. - 窪田貴之,渡邊実,「0.18 μm CMOSプロセスダイナミック光再構成型ゲートアレイVLSI」,
卒業研究発表会,電子情報通信学会 東海支部,pp. **-**, 名古屋大学,3月,2013. - 谷川彰,渡邊実,「マルチコンテキストを活用した光再構成型ゲートアレイの放射線耐性の向上方法」,
卒業研究発表会,電子情報通信学会 東海支部,pp. **-**, 名古屋大学,3月,2013. - 白橋侑弥,渡邊 実,「高速動的再構成を活用したディペンダブルシステムの構成手法」,
卒業研究発表会,電子情報通信学会 東海支部,pp. **-**, 名古屋大学,3月,2013. - 伊藤宏幸,渡邊実,「28nmプロセスFPGAへのモノ・インストラクション・セット・コンピュータの実装」,
静岡地区計測制御研究発表会,pp. 7-8, 12月,2012. - 窪田貴之,渡邊実,「0.18um CMOS プロセス ダイナミック光再構成型ゲートアレイVLSI」
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会)
Vol. 112,No. 325,Reconf2012-46-Reconf2012-60,pp. 23-27,九州大学医学部百年講堂,11月,2012 - 森脇烈,渡邊実,荻原昭文,「偏光依存性ホログラムメモリを用いた9コンテキスト光再構成型ゲートアレイ」,
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会)
Vol. 112,No. 325,Reconf2012-46-Reconf2012-60,pp. 29-32,九州大学医学部百年講堂,11月,2012 - 白橋侑弥,渡邊実,「高速動的再構成を活用したディペンダブルシステムの構成手法」
第56回宇宙科学技連合講演会,CD-ROM,11月,2012 - 谷川彰,渡邊実,「マルチコンテキストを活用した光再構成型ゲートアレイの放射線耐性の向上方法」
第56回宇宙科学技連合講演会,CD-ROM,11月,2012 - 上窪勇貴,渡邊実,川人祥二,「光再構成型ビジョンチップによる16諧調グレーレベル画像認識」
電子情報通信学会技術研究報告(VLSI設計技術研究会),
vol.112, no.245, pp.19-23,岩手県,ホテルルイズ,10月, 2012 - 伊藤宏幸,渡邊実,「モノ・インストラクション・セット・コンピュータ(MISC)の消費電力解析」
電子情報通信学会技術研究報告(VLSI設計技術研究会),
vol.112, no.245, pp.35-38,岩手県,ホテルルイズ,10月, 2012 - 渡邊貴弘,渡邊実,「0.18 μmプロセス反転・非反転光再構成型ゲートアレイVLSI」
電気関係学会東海支部連合大会,CD-ROM, 豊橋技術科学大学,9月,2012. - 伊藤宏幸,渡邊実,「モノ・インストラクション・セット・コンピュータ(MISC)の並列実装」
電気関係学会東海支部連合大会,CD-ROM, 豊橋技術科学大学,9月,2012. - 上窪勇貴,渡邊実,川人祥二,「高速動的再構成型ビジョンチップアーキテクチャによるアナログ画像検出」
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),
vol.112, no.203, pp.85-88, 滋賀県, 立命館大学,9月, 2012. - 余座貴志,渡邊実,「再構成速度調整アナログビットを含む光再構成型ゲートアレイのコンテキスト重ね合わせによる構成高速化手法」
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),
vol.112, no.203, pp.67-71, 滋賀県, 立命館大学,9月, 2012. - 荻原昭文,渡邊実,「光再構成型ゲートアレイ用マルチコンテキストデータの液晶ホログラム記録」
第73回応用物理学会学術講演会,DVD-ROM, 愛媛大学,9月,2012. - 余座貴志,渡邊実,「光再構成型ゲートアレイの再構成速度調整手法とレーザアレイ故障からの復旧試験」
電子情報通信学会東海支部卒業研究発表会,岐阜大学,3月,2012. - 鳥飼勇希,渡邊実,「光再構成型ゲートアレイへの三重回路実装」
電子情報通信学会東海支部卒業研究発表会,岐阜大学,3月,2012. - 渡邊貴弘,渡邊実,「0.18 μm CMOSプロセス差分光再構成型ゲートアレイVLSI」
情報処理学会 全国大会,名古屋工業大学,3月,2012. - 渡邊貴弘,渡邊実,「0.18μmプロセス光再構成型ゲートアレイVLSI」
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),
vol.111, no.397, VLD2011-117, pp.153-156, 神奈川県, 慶応大学, 1月, 2012. - 余座貴志,渡邊実,「再構成速度調整アナログビットを含む光再構成型ゲートアレイのレーザアレイ故障からの復旧試験」
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),
vol.111, no.397, VLD2011-118, pp.157-161, 神奈川県, 慶応大学, 1月, 2012. - 余座貴志,渡邊実,「ダイナミック光再構成型ゲートアレイのレーザアレイ故障からの復旧試験」
電子情報通信学会技術研究報告(回路とシステム研究会),
vol.111, no.377, CAS2011-105, pp.109-114, 福岡県, 九州大学, 1月, 2012. - 余座貴志,渡邊実,「光再構成型ゲートアレイの再構成速度調整手法」,
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),
vol. 111, no. 323, RECONF2011-43, pp.13-17 , 宮崎県, ニューウェルシティ宮崎,11月, 2011. - 上窪勇貴,渡邊実,川人祥二,「レンズアレイを使用した高速動的再構成型ビジョンチップアーキテクチャ」,
電子情報通信学会技術研究報告(信号処理研究会),
vol.111, no 257, SIP2011-75, pp.83-88 , 宮城県 作並温泉, 10月, 2011 - 仁平優基,渡邊実,「モノ・インストラクション・コンピュータの実装」,
電気関係学会東海支部連合大会,CD-ROM, 三重大学,9月,2011. - 渡邊貴弘,渡邊実,「光再構成型ゲートアレイに対する多数決レーザ駆動回路」,
電気関係学会東海支部連合大会,CD-ROM, 三重大学,9月,2011. - 鳥飼勇希,渡邊実,「光再構成型ゲートアレイへの三重回路実装」,
電気関係学会東海支部連合大会,CD-ROM, 三重大学,9月,2011. - 山地勇一郎,中田浩成,渡邊実,川人祥二,「動的再構成ビジョンチップアーキテクチャ上での並列テンプレートマッチング処理」
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),
vol.111, no 218, RECONF2011-35, pp.75-79 , 名古屋大学, 9月, 2011. - 渡邊貴弘,渡邊実,「位相ホログラムを用いたディペンダブル光再構成型ゲートアレイ」,
LSIとシステムのワークショップ, 講演資料集およびポスター資料集, pp. 281-283, 北九州国際会議場, 5月, 2011. - 渡邊貴弘,渡邊実,「位相ホログラムを用いた光再構成型ゲートアレイ」,
電子情報通信学会技術研究報告(光エレクトロニクス研究会),
vol.111, no 37, OPE2011-8, pp.1-5, 機械振興会館, 5月, 2011. - 山地勇一郎,渡邊実,「256コンテキストMEMS光再構成型ゲートアレイ」,
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),
vol.111, no 31, RECONF2011-21, pp.121-125 , 北海道大学, 5月, 2011. - 渡辺貴弘,渡邊実,「宇宙空間用ロバスト・プログラマブルデバイス」,
卒業研究発表会,電子情報通信学会 東海支部,3月,2011. - 中田浩成,渡邊実,「動的光再構成型ビジョンチップによるテンプレートマッチング」
卒業研究発表会,電子情報通信学会 東海支部,3月,2011. - 山地勇一郎,渡邊実,「MEMSマルチコンテキスト光再構成型ゲートアレイ」
卒業研究発表会,電子情報通信学会 東海支部,3月,2011. - 久保田,渡邊実,「プログラマブル光再構成型ゲートアレイとDMDを用いたライター」,
レーザー学会学術講演会第31回年次大会, 講演予稿集, 電気通信大学, 1月, 2011. - 森田,渡邊実,「MEMSダイナミック光再構成型ゲートアレイにおけるMEMS組立精度」,
電子情報通信学会技術研究報告(VLIS設計研究会),
vol.109, no 360, VLD2010-106, pp.151-156 , 慶応大学, 1月, 2011. - 森田,渡邊実,「ホログラム閾値可変によるMEMSダイナミック光再構成型ゲートアレイの動作効率改善法」,
第8回情報学ワークショップ(WiNF2010), CD-ROM,名古屋大学, 12月, 2010. - グンジャラム アマルジャルガル,渡邊実,「ダイナミック光再構成型ゲートアレイの動的部分再構成の性能評価」,
電子情報通信学会技術研究報告(電子部品・材料研究会),
vol. 110,No. 314, CPM2010-133,pp. 55-60,九州大学, 11月, 2010. - 渡邊貴弘,渡邊実,「ホログラムメモリシステムのレーザーアレイ故障の復旧方法」,
第54回宇宙科学技術連合講演会, CD-ROM, 静岡県コンベンションアーツセンター「グランシップ」,11月, 2010. - 森田,渡邊実,「光再構成型ゲートアレイにおけるMEMSアドレッシング技術」,
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),
vol. 110,No. 204, RECONF2010-30,pp. 73-78,静岡大学, 9月, 2010. - 渡邊貴弘,渡邊実,「光再構成型ゲートアレイのレーザアレイ故障の復旧方法」
電子情報通信学会技術研究報告(機構デバイス研究会),
vol. 110,No. 178, OPE2010-55,pp. 135-140,千歳アルカディアプラザ, 8月, 2010. - 山地,渡邊実,「64コンテキストMEMS光再構成型ゲートアレイ」
電子情報通信学会技術研究報告(機構デバイス研究会),
vol. 110,No. 178, OPE2010-56,pp. 140-144,千歳アルカディアプラザ, 8月, 2010. - 中田,渡邊実,「高速動的光再構成型イメージセンサのよる4点のテンプレートマッチング」
電子情報通信学会技術研究報告(機構デバイス研究会),
vol. 110,No. 178, OPE2010-57,pp. 145-148,千歳アルカディアプラザ, 8月, 2010. - 間渕,渡邊実,荻原,小林,「偏光依存性ホログラムメモリの偏光スイッチングを用いた光再構成試験」,
平成22年度電気関係学会東海支部連合大会, CD-ROM, 中部大学, 8月, 2010. - 久保田,渡邊実,「銀塩ホログラムを用いた4コンテキスト・プログラマブル光再構成型ゲートアレイ」,
平成22年度電気関係学会東海支部連合大会, CD-ROM, 中部大学, 8月, 2010. - 青山,渡邊実,「ダイナミック光再構成型ゲートアレイのばらつき補正技術」,
LSIとシステムのワークショップ, 講演資料集およびポスター資料集, pp. 188-190, 北九州国際会議場, 5月, 2010. - 森脇,渡邊実,「明点ビット数の最小化による順序回路の高速構成手法」,
LSIとシステムのワークショップ, 講演資料集およびポスター資料集, pp. 185-187, 北九州国際会議場, 5月, 2010. - 瀬戸,渡邊実,「ダイナミック光再構成型ゲートアレイのレーザー故障回避」,
第57回応用物理学関係連合講演会 講演予稿集,東海大学湘南キャンパス, p. 03-112, 3月, 2010. - 間渕,越智,渡邊実,荻原,小林,「偏光依存性ホログラムメモリを用いた光再構成試験」,
第57回応用物理学関係連合講演会 講演予稿集,東海大学湘南キャンパス, p. 03-087, 3月, 2010. - 荻原,越智,渡邊実,間渕,小林,「液晶を用いた光再構成型ゲートアレイ用異方性ホログラムメモリの作製」,
第57回応用物理学関係連合講演会 講演予稿集,東海大学湘南キャンパス, p. 12-232, 3月, 2010. - 保田,渡邊実,「動的再構成を用いたイメージセンサ」,
電子情報通信学会技術研究報告(画像工学研究会),
vol. 109,No. 469, IE2009-193,pp. 83-86,東北大学, 3月, 2010. - 森田,渡邊実,「差分光再構成手法に対する不良耐性」,
電子情報通信学会技術研究報告(画像工学研究会),
vol. 109,No. 469, IE2009-192,pp. 77-82,東北大学, 3月, 2010. - 青山,渡邊実,「アナログコンテクストを用いたフォトダイオード特性の補正手法」,
電子情報通信学会技術研究報告(VLSI設計技術研究会),
Vol. 109, no. 393, VLD2009-97, pp.171-174, 慶応義塾大学, 1月, 2010. - 上野,渡邊実,「光ファイバーを用いたリモートダイナミック光再構成型ゲートアレイ」,
電子情報通信学会技術研究報告(VLSI設計技術研究会),
vol.109, no. 393, VLD2009-96, pp.167-170, 慶応義塾大学, 1月, 2010. - 久保田,渡邊実,「銀塩ホログラムを用いたプログラマブル光再構成型ゲートアレイ」,
電子情報通信学会技術研究報告(VLSI設計技術研究会),
vol.109, no. 393, VLD2009-98, pp.175-179, 慶応義塾大学, 1月, 2010. - 瀬戸,渡邊実,「ダイナミック光再構成ゲートアレイのブロック再構成」,
電子情報通信学会技術研究報告(集積回路研究会),
vol.109, no. 405, ICD2009, pp.19-23 , 東芝本社, 1月, 2010. - 中島,渡邊実,「100コンテキスト光再構成型ゲートアレイ」,
第10回計測自動制御学会 システムインテグレーション部門 講演会論文集CD-ROM, 芝浦工業大学, 12月, 2009. - 上野,渡邊実,「4コンテキスト・リモート光再構成型ゲートアレイ」,
電子情報通信学会技術研究報告(集積回路研究会),
vol. 109, no. 336, ICD2009-97, pp. 117-120, 静岡大学, 12月, 2009. - 中島,渡邊実,「宇宙放射線に対して高い耐性を持つ光バッファリング手法」,
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),
Vol. 109, No. 320, RECONF2009-44, pp. 13-18, 高知文化プラザ, 12月, 2009. - 瀬戸,渡邊実,「MEMSを用いた反転・非反転ダイナミック光再構成型ゲートアレイ」
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),
Vol. 109, No. 320, RECONF2009-43, pp. 7-12, 高知文化プラザ, 12月, 2009. - 久保田,渡邊実,「プログラマブル光再構成型ゲートアレイのホログラム窓の影響解析」,
電子情報通信学会技術研究報告(VLSI設計技術研究会),
Vol. 109, No. 315, VLD2009-56, pp.101-105,高知文化プラザ, 12月, 2009. - 森田,渡邊実,「ディジタルミラーデバイスを用いた差分光再構成型ゲートアレイ」
電子情報通信学会技術研究報告(信号処理研究会),
Vol. 109,No. 226, SIP2009-56,pp. 1-5,福井県 芦原温泉,10月,2009. - 青山,渡邊実,「アナログコンテキストを用いた光再構成の最適化手法」
電子情報通信学会技術研究報告(信号処理研究会),
Vol. 109,No. 226, SIP2009-57,pp. 7-10,福井県 芦原温泉,10月,2009. - 上野,渡邊実,「光ファイバを用いたリモート光再構成型ゲートアレイ」,
電子情報通信学会技術研究報告(VLSI設計技術研究会),
Vol. 109, no. 201, VLD2009-40, pp. 63-66, 大阪大学, 9月, 2009. - 瀬戸,渡邊実,「MEMSダイナミック光再構成型ゲートアレイの不良耐性」,
電子情報通信学会技術研究報告(VLSI設計技術研究会),
Vol. 109, no. 201, VLD2009-42, pp. 71-76, 大阪大学, 9月, 2009. - 森脇,渡邊実,「負論理回路実装による光再構成の高速化手法」,
電子情報通信学会技術研究報告(VLSI設計技術研究会),
Vol. 109, no. 201, VLD2009-41, pp. 67-70, 大阪大学, 9月, 2009. - 間渕,宮城,渡邊実,荻原,「不揮発性液晶ホログラムメモリを用いた光再構成型ゲートアレイの不良耐性」,
第53回宇宙科学技術連合講演会, CD-ROM , 京都大学, 9月, 2009. - 森田,渡邊実,「MEMSを使用した光再構成技術」,
第53回宇宙科学技術連合講演会, CD-ROM, 京都大学, 9月, 2009. - 久保田,渡邊実,「レンズ結像系を用いないプログラマブル光再構成型ゲートアレイ用ライター」,
第53回宇宙科学技術連合講演会, CDROM , 京都大学, 9月, 2009. - 中島,渡邊実,「36コンテキスト光再構成形ゲートアレイにおける高速再構成」,
平成21年度電気関係学会東海支部連合大会, CD-ROM, 愛知工業大学, 9月, 2009. - 瀬戸,渡邊実,「MEMSを用いたダイナミック光再構成型ゲートアレイ」,
平成21年度電気関係学会東海支部連合大会, CD-ROM, 愛知工業大学, 9月, 2009. - 久保田,渡邊実,「レンズ結像系を用いない4コンテキストプログラマブル光再構成型ゲートアレイ用ライター」,
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),
Vol. 109, no198, RECONF2009-37, pp. 109-112, 宇都宮大学, 9月, 2009. - 中島,渡邊実,「36コンテキストダイナミック光再構成形ゲートアレイ」,
電子情報通信学会技術研究報告(レーザ・量子エレクトロニクス研究会),
vol. 109, no. 173, LQE2009-41, pp. 41-46, 東北大学, 8月, 2009. - 森田,渡邊実,「デジタルミラーデバイスを用いた4コンテキスト光再構成」,
電子情報通信学会技術研究報告(光エレクトロニクス研究会),
vol. 109, no. 173, OPE2009-81, pp. 37-40, 東北大学, 8月, 2009. - 間渕, 宮城, 渡邊実, 荻原, 「不揮発性液晶ホログラムメモリを用いたダイナミック光再構成型ゲートアレイの故障耐性」,
電子情報通信学会技術研究報告(回路とシステム研究会),
vol. 109, no. 110, CAS2009-20, pp. 109-112, 釧路市生涯学習センター, 7月, 2009. - 森田, 渡邊実, 「デジタルミラーデバイスを用いた光再構成」,
電子情報通信学会技術研究報告(回路とシステム研究会),
vol. 109, no. 110, CAS2009-21, pp. 113-116, 釧路市生涯学習センター, 7月, 2009. - 間渕, 宮城, 渡邊実, 荻原, 「不揮発性液晶ホログラムメモリを用いたダイナミック光再構成型ゲートアレイ」,
LSIとシステムのワークショップ, pp. 277-279, 北九州国際会議場, 5月, 2009. - 森田, 渡邊実, 「光再構成型ゲートアレイの組み立て誤差・総合補正手法」,
LSIとシステムのワークショップ, pp. 286-288, 北九州国際会議場, 5月, 2009. - 久保田, 渡邊実, 「斜め入射光源を用いたプログラマブル光再構成型ゲートアレイ」,
LSIとシステムのワークショップ, pp. 289-291, 北九州国際会議場, 5月, 2009. - 瀬戸,渡邊実,「11,424ゲートダイナミック光再構成型ゲートアレイへの多数決回路実装 」,
第56回応用物理学関係連合講演会 講演予稿集,筑波大学, p. , 3月, 2009. - 久保田,渡邊実,「プログラマブル・ダイナミック光再構成型ゲートアレイ」,
第56回応用物理学関係連合講演会 講演予稿集,筑波大学, p. , 3月, 2009. - 中島,渡邊実,「16コンテキスト光再構成型ゲートアレイ」,
電子情報通信学会技術研究報告(回路とシステム研究会),
vol. 108, no. 453, CAS2008-111, pp. 61-65, 岐阜長良川温泉国際会議場, 3月, 2009. - 間渕, 宮城, 渡邊実, 荻原,「不揮発性液晶ホログラムメモリを用いた光再構成型ゲートアレイ」,
電子情報通信学会技術研究報告(回路とシステム研究会),
vol. 108, no. 453, CAS2008-112, pp. 67-70, 岐阜長良川温泉国際会議場, 3月, 2009. - 中島,渡邊実,「9コンテキスト差分光再構成型ゲートアレイの高速再構成試験」,
電子情報通信学会技術研究報告(集積回路研究会),
vol. 108, no. 347, ICD2008-116, pp. 67-72, 東工大(大岡山), 12月, 2008. - 瀬戸,渡邊実,「ダイナミック光再構成型ゲートアレイのゲートアレイ部の性能評価」,
電子情報通信学会技術研究報告(集積回路研究会),
vol. 108, no. 347, ICD2008-117, pp. 73-78, 東工大(大岡山), 12月, 2008. - 加藤,渡邊実,「反転・非反ダイナミック転光再構成アーキテクチャのエミュレーション試験」,
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),
vol. 108, no. 300, RECONF2008-38, pp. 1-4, 北九州学術研究都市, 11月, 2008. - 中島,渡邊実,「宇宙放射線に対して高い耐性を持つ光再構成型ゲートアレイの高速再構成試験」,
第52回宇宙科学技術連合講演会 講演予稿集,淡路夢舞台国際会議場, p. 48, 11月, 2008. - 瀬戸,渡邊実,「完全並列プログラミングが可能なダイナミック光再構成型ゲートアレイ」,
第52回宇宙科学技術連合講演会 講演予稿集,淡路夢舞台国際会議場, p. 48, 11月, 2008. - 森田,渡邊実,「光再構成型ゲートアレイのホログラム部の組み立て精度について」,
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),
vol. 108, no. 300, RECONF2008-38, pp. 5-8,北九州学術研究都市, 11月, 2008. - 中島,渡邊実,「13.75ns高速ホログラム光再構成」,
電子情報通信学会技術研究報告(シリコン材料・デバイス研究会),
vol. 108, no. 292, SDM2008-171, pp. 15-19, 機械振興会館, 11月, 2008. - 瀬戸,渡邊実,「大規模光再構成型ゲートアレイにおけるホログラムメモリの不良耐性」,
電子情報通信学会技術研究報告(シリコン材料・デバイス研究会),
vol. 108, no. 292, SDM2008-172, pp. 21-25,機械振興会館, 11月, 2008. - 中島,渡邊実,「光再構成型ゲートアレイにおけるマルチスピード再構成」,
第69回応用物理学会学術講演会 講演予稿集,中部大学, p. 881, 9月, 2008. - 久保田,渡邊実,「PAL-SLM を用いたプログラマブルな光再構成型ゲートアレイとライター」,
第69回応用物理学会学術講演会 講演予稿集,中部大学, p. 882, 9月, 2008. - 野田,渡邊実,「光再構成型ゲートアレイへの多数決回路の実装」,
第69回応用物理学会学術講演会 講演予稿集,中部大学, p. 882, 9月, 2008. - 森田,渡邊実,「光再構成型ゲートアレイの組み立て許容誤差」,
第69回応用物理学会学術講演会 講演予稿集,中部大学, p. 756, 9月, 2008. - 間渕,渡邊実,「再構成時間の最適化が可能なダイナミック光再構成型ゲートアレイ」,
第69回応用物理学会学術講演会 講演予稿集,中部大学, p. 757, 9月, 2008. - 加藤,渡邊実,「ゼロオーバーヘッド・高速ダイナミック光再構成型ゲートアレイ VLSI」,
第69回応用物理学会学術講演会 講演予稿集,中部大学, p. 757, 9月, 2008. - 加藤,渡邊実,「高速ダイナミック光再構成型ゲートアレイ VLSI」,
電子情報通信学会技術研究報告(VLSI設計技術研究会), vol. 108, no. 224, VLD2008-56, pp.61-65, 金沢商工会議所会館, 9月, 2008. - 久保田,渡邊実,「PAL-SLMを用いたプログラマブルなマルチコンテキスト光再構成型ゲートアレイ」,
電子情報通信学会技術研究報告(VLSI設計技術研究会), vol. 108, no. 224, VLD2008-56, pp.67-70,金沢商工会議所会館, 9月, 2008. - 中島,渡邊実,「大規模光再構成型ゲートアレイにおける高速再構成試験」,
電子情報通信学会技術研究報告(VLSI設計技術研究会), vol. 108, no. 224, VLD2008-56, pp.55-59,金沢商工会議所会館, 9月, 2008. - 瀬戸,渡邊実,「大規模ゲート光再構成型ゲートアレイの保持時間の測定」,
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会), vol. 108, no. 220, RECONF2008-31, pp. 51-55, 岡山大学, 9月, 2008. - 加藤,渡邊実,「反転・非反転ダイナミック光再構成アーキテクチャのゼロオーバーヘッド・ノンゼローバーヘッドVLSI の比較評価」,
情報フォトニクス研究グループ研究会,p. 21, 寸又峡公民館, 9月, 2008. - 間渕,渡邊実,「9 コンテキスト光再構成型ゲートアレイ」,
情報フォトニクス研究グループ研究会,p. 20, 寸又峡公民館, 9月, 2008. - 森田,渡邊実,「光再構成型ゲートアレイの組み立て精度」,
情報フォトニクス研究グループ研究会,p. 22, 寸又峡公民館, 9月, 2008. - 中島,渡邊実,「4コンテキストDORGAにおける高速再構成」,
電子情報通信学会技術研究報告(光エレクトロニクス研究会),
vol. 108. no. 191, OPE2008-66, pp. 21-26, 東北大学, 8月, 2008. - 瀬戸,渡邊実,「大規模ダイナミック光再構成型ゲートアレイVLSIの評価」,
電子情報通信学会技術研究報告(光エレクトロニクス研究会),
vol. 108. no. 191, OPE2008-67, pp. 27-31,東北大学, 8月, 2008. - 瀬戸,渡邊実,「銀塩ホログラムメモリを用いたマルチコンテキスト・ダイナミック光再構成型ゲートアレイ」,
電子情報通信学会技術研究報告,
vol. 108. no. 48, RECONF2008-11, pp. 61-64, 会津大学, 5月, 2008. - 中島,渡邊実,「4コンテキスト光再構成型ゲートアレイによる高速再構成」,
電子情報通信学会技術研究報告, vol. 108. no. 48, RECONF2008-12, pp. 65-69, 会津大学, 5月, 2008. - 瀬戸,渡邊実,「銀塩ホログラムを使用したダイナミック光再構成型ゲートアレイの保持時間の解析」,
第55回応用物理学関係連合講演会 講演予稿集,日本大学理工学部, p. 1059, 3月, 2008. - 中島,渡邊実,「マルチコンテキスト光再構成型ゲートアレイにおける高速再構成」
第55回応用物理学関係連合講演会 講演予稿集,日本大学理工学部, p. 1059, 3月, 2008. - 山口,渡邊実,「2つのVCSELレーザを用いたマルチコンテキスト光再構成型ゲートアレイ」,
第55回応用物理学関係連合講演会 講演予稿集,日本大学理工学部, p. 1059, 3月, 2008. - 加藤,渡邊実,「反転・非反転ダイナミック光再構成アーキテクチャの比較評価」,
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会), vol. 108, no. 414, RECONF2008-63, pp. 45-50, 慶応義塾大学(日吉) , 1月, 2008. - 間渕,渡邊実,「4コンテキスト光再構成型ゲートアレイの実証」,
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),
vol. 108, no. 414, RECONF2008-62, pp. 41-44, 慶応義塾大学(日吉) , 1月, 2008. - 久保田,渡邊実,「9コンテキスト・プログラマブル光再構成型ゲートアレイとライター」,
電子情報通信学会技術研究報告(リコンフィギャラブルシステム研究会),
vol. 108, no. 414, RECONF2008-61, pp. 37-40, 慶応義塾大学(日吉) , 1月, 2008. - 中島,渡邊実,「9コンテキスト光再構成ゲートアレイによる高速再構成」,
電子情報通信学会技術研究報告(回路とシステム研究会), vol. 108, no. 388, CAS2008-75, pp. 63-67, ホテルマリックス(宮崎), 1月, 2008. - 森田,渡邊実,「光再構成型ゲートアレイの組み立て誤差補正手法」,
電子情報通信学会技術研究報告(回路とシステム研究会), vol. 108, no. 388, CAS2008-74, pp. 59-62, ホテルマリックス(宮崎), 1月, 2008. - 瀬戸,渡邊実,「ダイナミック光再構成アーキテクチュアの連続再構成における保持時間の解析」,
電子情報通信学会技術研究報告, vol. 107. no. 419, RECONF2007-71, pp. 43-47, 2008. - 中島,渡邊実,「ダイナミック光再構成型ゲートアレイの高速再構成試験」,
電子情報通信学会技術研究報告, vol. 107. no. 419, RECONF2007-72, pp. 49-52, 2008. - 篠原,渡邊実,「光再構成ゲートアレイのホログラムメモリに対する不良耐性解析」,
電子情報通信学会技術研究報告,vol. 107. no. 419, RECONF2007-73, pp. 53-57, 2008. - 日高,小林,渡邊実,「動的再構成のための配置配線の一手法」,
電子情報通信学会技術研究報告, vol. 107, no. 341, RECONF2007-38, pp. 13-17, 2007. - 瀬戸,渡邊実,「照射時間を一定としたダイナミック光再構成型ゲートアレイの保持時間の解析」,
電子情報通信学会技術研究報告,vol. 107, no. 295, VLD2007-60, pp. 47-52, 2007. - 中島,渡邊実,「マルチコンテキスト光再構成型ゲートアレイによる高速動的光再構成」
電子情報通信学会技術研究報告,vol. 107, no. 295, VLD2007-61, pp. 53-57, 2007. - 山口,渡邊実,「コンテキスト重ね合わせによる高速光再構成」,
電子情報通信学会技術研究報告,vol. 107, no. 295, VLD2007-62, pp. 59-62, 2007. - 山口,渡邊実,「マルチコンテキスト光再構成型ゲートアレイ」,
電子情報通信学会技術研究報告, vol. 107, no. 225, RECONF2007-18, pp. 19-22, 2007. - 中島,渡邊実,「ODRGA-VLSIのゲートアレイ動作時における高速再構成」,
電子情報通信学会技術研究報告, vol. 107, no. 225, RECONF2007-19, pp. 23-27, 2007. - 瀬戸,渡邊実,「ダイナミック光再構成アーキテクチュアの再構成時間と保持時間の測定」,
電子情報通信学会技術研究報告, vol. 107, no. 225, RECONF2007-20, pp. 29-33, 2007. - 日高,渡邊実,小林,「光再構成型ゲートアレイの製造不良耐性」,
電子情報通信学会技術研究報告, RECONF2006-20, pp.1-5, 2006. - 日高,渡邊実,小林,「差分光再構成型ゲートアレイの再構成時間・消費電力の最適化手法」,
電子情報通信学会技術研究報告, RECONF2006-21, pp.7-11, 2006. - 中田,渡邊実,小林,「液晶ホログラムを用いた光再構成型ゲートアレイ」,
電子情報通信学会技術研究報告, RECONF2006-22, pp.13-16, 2006. - 井上,小林,渡邊実,「位相補間によるPLLの特性改善 ~ 位相補間回路の最適化 ~」,
電子情報通信学会技術研究報告, CAS2005-89, pp.13-17, 2006. - 深川,渡邊実,小林,「ダイナミック光再構成型ゲートアレイ」,
第11回計測自動制御学会九州支部講義会予稿, 103B-5, 2006. - 後藤,渡邊実,小林,「ゼロオーバーヘッド・ダイナミック光再構成型ゲートアレイ」,
第11回計測自動制御学会九州支部講義会予稿, 103B-6, 2006. - 井上,小林,渡邊実,「位相補間によるPLLの特性改善:ジッタ低減のための高精度補間」,
第11回計測自動制御学会九州支部講義会予稿, 102D-1, 2006. - 櫻井,小林,渡邊実,「動的再構成システム開発環境」,
第11回計測自動制御学会九州支部講義会予稿, 204A-4, 2006. - 山口,小林,渡邊実,「デジタルオーディオの統合開発環境 -RHDLによるFPGA開発-」,
第11回計測自動制御学会九州支部講義会予稿, 204A-6, 2006 - 志岐,渡邊実,小林,「272ゲート規模ODRGA-VLSIの実装評価」,
電子情報通信学会技術研究報告vol. 105, No. 184, pp. 61-65, 2005. - 宮野,渡邊実,小林,「複数のVCSELを用いたODRGAの再構成速度改善」,
電子情報通信学会技術研究報告vol. 105, No. 184, pp. 67-70, 2005. - 渡邊実,小林,「動的再構成によるシステム実現」,
第6回システムインテグレーション部門講演会,pp. 571-572, 2005. - 櫻井,小林,渡邊実,「光再構成ゲートアレイのプログラム支援環境」,
第24回計測自動制御学会九州支部学術講演会予稿, pp. 141-142, 2005. - 志岐,渡邊実,小林,「0.18umプロセスによる差分光再構成型ゲートアレイVLSI」,
第24回計測自動制御学会九州支部学術講演会予稿, pp. 143-144, 2005. - 藤目,渡邊実,小林,「光再構成型ゲートアレイの再構成回路の評価」,
第24回計測自動制御学会九州支部学術講演会予稿, pp. 135-136, 2005. - 松尾,渡邊実,小林,「光再構成型ゲートアレイの検査手法」,
第24回計測自動制御学会九州支部学術講演会予稿, pp. 133-134, 2005. - 福井,小林,渡邊実,「フィルタ/Fourierハイブリッド型サンプルレートコンバータ」
第24回計測自動制御学会九州支部学術講演会予稿, 202A5, 2005. - 井上,小林,渡邊実,「位相補間によるPLLの特性改善」,
第24回計測自動制御学会九州支部学術講演会予稿, 202A6, 2005. - 井上,小林,渡邊実,「PLLジッタ低減のためのオーバ・サンプリング位相比較器」
電子情報通信学会・2005ソサイエティ大会,A-1-19,2005. - 宮野,渡邊実,小林,「パルスレーザを用いた差分型再構成ゲートアレイ」,
電子情報通信学会技術研究報告 vol. 104, No. 476, pp. 1-4, 2004.141. - 志岐,渡邊実, 小林,「差分光再構成型ゲートアレイVLSI」,
電子情報通信学会技術研究報告,vol. 104, No. 476, pp. 5-9, 2004. - 藤目,渡邊実, 小林,「光再構成型ゲートアレイの再構成回路の評価」,
電子情報通信学会技術研究報告,vol. 104, No. 476, pp. 11-15, 2004. - 渡邊実,小林,「0.18umプロセスによる差分光再構成型ゲートアレイ」,
電子情報通信学会技術研究報告,vol. 104, No. 363, pp. 61-66, 2004. - 宮野, 渡邊実, 小林,「差分型光再構成ゲートアレイの領域分割照射」
電子情報通信学会技術研究報告, pp. 227-234, 2004. - 宮野, 渡邊実, 小林, 「VCSELを用いた差分型光再構成ゲートアレイ」,
電子情報通信学会・集積光デバイス技術時限研究専門委員会, pp. 29-34, 2004. - 宮野, 渡邊実, 小林, 「差分型光再構成ゲートアレイの照射領域と再構成速度の評価」
第8回システムLSIワークショップ , pp. 323-326, 2004. - 松尾,渡邊実,小林,「光再構成型ゲートアレイの検査手法」,
第23回計測自動制御学会九州支部学術講演会予稿, 203B1, 2004. - 植田,渡邊実,小林,「ダイナミック差分光再構成型ゲートアレイ」,
第23回計測自動制御学会九州支部学術講演会, 203B6, 2004. - 山角,小林,渡邊実,「光再構成型ゲートアレイのプログラミング環境」,
第23回計測自動制御学会九州支部学術講演会予稿, 203B2, 2004. - 宮野,渡邊実,小林,「差分型光再構成ゲートアレイの光再構成タイミング解析」,
第23回計測自動制御学会九州支部学術講演会予稿, 203C1, 2004. - 井上,小林,渡邊実,「フーリエ補間によるサンプリング・レート変換」,
第23回計測自動制御学会九州支部学術講演会予稿, 102B5, 2004. - 藤目,渡邊実, 小林,「差分光再構成型ゲートアレイに使用するダイナミック再構成回路」
電子情報通信学会技術研究報告Vol. 103, No. 510, pp. 7-10, 2003. - 宮野, 渡邊実, 小林, 「差分型光再構成ゲートアレイの回路実装評価」,
第7回システムLSIワークショップ, pp. 335-338 , 2003. - 中村, 小林, 渡邊実 , 「差分型光再構成ゲートアレイの開発支援システム 」,
第22回計測自動制御学会九州支部学術講演会予稿, 203C1 , 2003. - 志岐, 渡邊実, 小林, 「差分型光再構成ゲートアレイVLSI部の遅延シミュレーション」,
第22回計測自動制御学会九州支部学術講演会予稿, 203C7, 2003. - 宮野, 渡邊実, 小林, 「差分型光再構成ゲートアレイの連続再構成」,
第22回計測自動制御学会九州支部学術講演会予稿, 203A2, 2003 . - 渡邊実, 小林,「有限な物理量を用いたニューラルネットワーク」
電子情報通信学会技術研究報告,vol. 101, No. 735, pp. 115-118, 2002. - 渡邊実, 小林, 「有限な物理量を用いたニューラルネットワークモデルのVLSI実装」,
第6回システムLSIワークショップ, pp. 291-294, 2002. - 三浦, 小林, 渡邊実, 「時間領域におけるサンプリングレート変換」,
第21回計測自動制御学会九州支部・学術講演会予稿集, pp. 181-182, 2002. - 渡邊実, 小林, 「有限な物理量を用いたニューラルネットワークモデルのLSI実装」,
第21回計測自動制御学会九州支部学術講演会予稿集, pp. 383-384, 2002. - 松本, 渡邊実, 小林, 「光再構成型ゲートアレイ」, 第5回システムLSIワークショップ, pp. 339-342, 2001.
- 外枦保, 渡邊実, 小林, 「ニューラルネットワークの回路実現 :再構成による可変パラメータアーキテクチャー」,
第5回システムLSIワークショップ, pp. 347-350, 2001. - 尼崎, 小林, 渡邊実, 八木, 「シリコン網膜アクティブセンサによる動画像圧縮回路」,
第20回計測自動制御学会九州支部学術講演会予稿集, 102D3, 2001. - 千, 小林, 渡邊実, 「知能化工作機械のためのセンサー内蔵型計測工具」,
第20回計測自動制御学会九州支部学術講演会予稿集, 103D3, 2001. - 松永, 小林, 渡邊実, 石川, 廣津, 「SIMD型アーキテクチュアにおける規則的不均一演算実装の手法」,
第40回計測自動制御学会予稿集, 310C4, 2001. - 渡邊実, 小林, 「エネルギーニューラルネットワークモデルを用いた負ニューロン生成方法」,
第20回計測自動制御学会九州支部学術講演会予稿集, 204C2, 2001. - 渡邊実, 外枦保, 小林, 「新型エネルギーニューラルネットワークモデルのハードウエア実現」,
第40回計測自動制御学会予稿集, 310A4, 2001. - 外枦保, 渡邊実, 小林, 「FPGAを利用したニューラルネットワークのハードウエア実現」,
第40回計測自動制御学会予稿集, 310A5, 2001. - 緒方, 渡邊実, 小林, 「光再構成型ゲートアレイとその応用」,
第40回計測自動制御学会予稿集, 310A6, 2001. - 大都, 小林, 渡邊実, 八木, 「アナログビジョンチップのための適応型前処理回路」,
第19回計測自動制御学会九州支部学術講演会予稿集, 201, 2000. - 松永, 小林, 渡邊実, 廣津, 「デジタルビジョンチップによる並列特徴抽出」,
第19回計測自動制御学会九州支部学術講演会予稿集, 202, 2000. - 緒方, 渡邊実, 小林, 「光再構成型ゲートアレイと応用」,
第19回計測自動制御学会九州支部学術講演会予稿集, 215, 2000. - 渡邊実, 小林, 「ニューラルネットワークの論理圧縮手法とそのLSI化」,
第39回計測自動制御学会学術講演会予稿集, 208A2, 2000. - 渡邊実, 小林, 「多層エネルギー制限型ニューラルネットワークシステム」,
第19回計測自動制御学会九州支部学術講演会予稿集, 214, 2000. - 渡邊実, 大坪, 「2値マトリックスを持つ光アソシアトロンの階層化」,
第41回応用物理学会予稿集, p. 864, 1994. - 渡邊実, 大坪, 竹森, 「FLCとLCTVを用いた光アソシアトロンの学習」,
第40回応用物理学会予稿集, p. 931, 1993. - 渡邊実, 大坪, 「光RAMとLCTVを用いた光アソシアトロンの学習想起システムの検討」,
第40回応用物理学会予稿集, p.900, 1993. - 渡邊実, 荻原, 大坪, 「微小レンズアレイとLCTVを用いた光アソシアトロン」, 第39回応用物理学会予稿集, p. 846, 1992.
■特許
- 渡邊実,小林,「光再構成ゲートアレイの再構成制御装置及びその方法」,
出願人 科学技術振興事業団・国立大学法人 九州工業大学,特許第4923257号(2012年2月17日),出願2006年11月24日. PCT/JP2007/65085 - 渡邊実,小林,「光再構成ゲートアレイの再構成制御装置及びその方法」,
出願人 科学技術振興事業団・国立大学法人 九州工業大学,特許第4923251号(2012年2月17日),出願2006年8月28日 - 渡邊実,小林,「光学的メモリの記録方法及び光学的メモリ」,
出願人 科学技術振興事業団・国立大学法人 九州工業大学,特許第4734641(2011年5月13日),出願2006年2月20日. - 渡邊実,小林,「光信号保持回路及び光信号保持回路アレイ」,
出願人 科学技術振興事業団・国立大学法人 九州工業大学,特許第4535320号(2010年6月25日),出願2004年7月23日. - 渡邊実, 小林,「光再構成型ゲートアレイの書込状態検査方法及び書込状態検査装置、並びに光再構成型ゲートアレイ」,
出願人 科学技術振興事業団・国立大学法人 九州工業大学,特許第4544620号(2010年7月9日),出願2004年6月18日,PCT/JP2005/11026. - 渡邊実,小林,「光再構成型ゲートアレイのデータ書込装置及びデータ書込方法」,
出願人 国立大学法人九州工業大学,特許第4452821号(2010年2月12日),出願2003年7月25日. - 渡邊実,小林,「光再構成可能論理回路」,出願人 科学技術振興事業団,
特許第4121138号(2009年5月9日),PCT/JP2005/008612 ,出願2006年5月11日. - 渡邊実,小林,「光再構成型ゲートアレイおよびそのリセット方法」,
出願人 科学技術振興事業団,特許第4033818号(2007年11月2日),出願2003年7月4日 - 渡邊実,小林,「光再構成型ゲートアレイの光照射位置補正装置及び光再構成型ゲートアレイの光照射位置補正方法 」,
出願人 科学技術振興事業団,特許第3916592号(2007年2月16日), 出願2003年7月10日. - 大都, 渡邊実, 小林, 八木, 「イメージセンサ用画像処理方法および装置」,
出願人 科学技術振興事業団, 特許第3758994号(2006年1月13日), 出願2001年5月28日. - 渡邊実, 小林, 「光再構成型ゲートアレイへのデータ書き込み方法および装置」,
出願人 科学技術振興事業団, 特許第3649711号(2005年2月25日), 出願2002年7月31日. - 渡邊実, 小林, 「光再構成型ゲートアレイおよびその再構成方法」,
出願人 科学技術振興事業団, 特許第3456981号(2003年8月1日), 出願2001年5月25日. - 渡邊実, 「自動工具交換装置」,
出願人 日産自動車(株), 特許第3518408号, 1999年4月8日. - 渡邊実, 「基板検査装置」,
出願人 日産自動車(株), 特許第3629820号, 1996年6月6日.
■助成金
●科学研究費(9件)
- 研究課題: 光電子ウエハースケールVLSIと光ブローバーの研究
種目/番号: 挑戦的研究(開拓) /22K18415
研究期間: 2022~2024年度
研究者: 渡邊実(研究代表者)
金額: 2587万円(間接経費597万円含む) - 研究課題: 1GradTID耐放射線光電子デバイスへのマルチコンテキストスクラビング実装
種目/番号: 基盤研究(B)/21H03407
研究期間: 2021~2023年度
研究者: 渡邊実(研究代表者)
金額: 1703万円(間接経費393万円含む) - 研究課題: 宇宙機器向けシールドレス耐放射線プログラマブルデバイスの研究開発
種目/番号: 基盤研究(B)/15H02676
研究期間: 2015~2017年度
研究者: 渡邊実(研究代表者)
金額: 1807万円(間接経費417万円含む) - 研究課題: 回折限界を打破する偏光ホログラムメモリシステムの研究開発
種目/番号: 挑戦的萌芽研究/ 25630145
研究期間: 2013~2015年度
研究者: 渡邊実(研究代表者)
金額: 390万円(間接経費90万円含む) - 研究課題: 3次元光電子機械プログラマブルデバイスの開発と動的回路実装技術の確立
種目/番号: 基盤研究(B)/24300017
研究期間: 2012~2014年度
研究者: 渡邊実(研究代表者)、大坪
金額: 1794万円(間接経費414万円含む) - 研究課題: MEMS・ホログラムを用いたリアルタイム視覚情報処理システム
種目/番号: 挑戦的萌芽研究/23650087
研究期間: 2011~2012年度
研究者: 渡邊実(研究代表者)
金額: 377万円(間接経費87万円含む) - 研究課題: MEMS・レーザーアレイによる高速動的光再構成型ゲートアレイの研究開発
種目/番号: 新学術領域研究/20200027
研究期間: 2008~2010年度
研究者: 渡邊実(研究代表者)、小林、荻原
金額: 3380万円(間接経費780万円含む) - 研究課題: プログラマブル・光再構成型ゲートアレイとライターの研究開発
種目/番号: 基盤研究(C)/20560322
研究期間: 2008~2010年度
研究者: 渡邊実(研究代表者)
金額: 455万円(間接経費105万円含む) - 研究課題: フーリエ補間による省回路サンプルレート変換器
種目/番号: 基盤研究(C)/20500156
研究期間: 2008~2010年度
研究者: 小林,渡邊実(研究分担者)
総額: 377万円(間接経費87万円含む)
分担額: 65万円(間接経費15万円含む) - 研究課題: 光VLSIにおける配線を利用した光シールド技術の開発
種目/番号: 若手研究(B)/18760256
研究期間: 2006~2007年度
研究者: 渡邊実(研究代表者)
金額: 350万円 - 研究課題: ダイナミック差分再構成型ゲートアレイ
種目/番号: 若手研究(B)/16760275
研究期間: 2004~2005年度
研究者: 渡邊実(研究代表者)
金額: 370万円
●政府系競争的資金(9件)
- 研究課題:耐放射線プロセッサを用いた組み込みシステムの開発
助成金名:日本原子力研究開発機構 英知を結集した原子力科学技術・人材育成推進事業 国際協力型廃炉研究プログラム(日英原子力共同研究)(研究代表者)
助成期間:2022~2024年度
金額:6000万円(予定) - 研究課題:再臨界前の中性子線増に即応可能な耐放射線FPGAシステムの開発
助成金名:英知を結集した原子力科学技術・人材育成推進事業
国際協力型廃炉研究プログラム(日英原子力共同研究)(研究代表者)
助成期間:2019~2021年度
金額:1998万8647円/2019年度、2000万円/2020年度、2000万円/2021年度 - 研究課題:耐放射線光電子融合デバイスへのマルチコンテキストスクラビングの実装
助成金名:総務省・戦略的情報通信研究開発推進制度(SCOPE)
社会展開指向型研究開発(3年枠)フェーズ1(研究代表者)
助成期間:2019~2021年度
金額:303万2130円(間接経費69万9722円含む)/2019年度,1300万円/2020年度、1300万円/2021年度 - 研究課題:廃炉作業ロボット向け耐放射線組み込みシステムの開発
助成金名:英知を結集した原子力科学技術・人材育成推進事業
廃炉加速化研究プログラム(国内研究)(研究代表者)
助成期間:2016~2018年度
金額:1955万8777円/2016年度、1909万5651円/2017年度、1969万4695円/2018年度 - 研究課題:ディペンダブル光FPGAの研究開発
助成金名:総務省・戦略的情報通信研究開発推進制度(SCOPE)
【ICTイノベーション創出型研究開発】
社会にパラダイムシフトをもたらす技術革新の推進(研究代表者)
助成期間:2012年度
金額: 1863万6800円(間接経費430万800円含む) - 研究課題:ホログラムストレージデバイス向けMEMS・レーザアレイ・アドレッシング技術
助成金名:JST・大学特許価値向上支援(試験研究実施責任者)
助成期間:2011年度
金額: 350万円(間接経費73万7000円含む) - 研究課題:高速動的光再構成型プロセッサの研究開発
助成金名:総務省・戦略的情報通信研究開発推進制度(SCOPE)
若手ICT研究者育成型研究開発(B)(研究代表者)
助成期間:2008~2010年度
金額: 1811万4200円(間接経費418万200円含む) - 助成金名:(独)日本学術振興会・国際学会等派遣事業 第1期
助成期間:2008年度
金額: 20万5000円 - 研究課題:部分再構成可能な高密度光再構成型ゲートアレイの開発
助成金名:JST・育成研究(研究代表者)
助成期間:2004~2006年度
金額: 8789万円 - 研究課題:組み込みシステム用再構成可能システム
助成金名:文部科学省・知的クラスタ創成事業(研究分担者)
助成期間:2002~2006年度
金額: 1億193万円(分担研究への配分額:2781万円)
●財団・企業他(8件)
- 研究課題:耐放射線イメージセンサーの研究開発
助成金名:日立GEニュークリアエナジー(研究代表者)
助成期間:2020年3月~2021年3月
金額: 275万6000円(間接経費63万6000円を含む) - 研究課題:耐放射線イメージセンサーの研究開発
助成金名:日立製作所(研究代表者)
助成期間:2019年10月~2021年3月
金額: 110万円(間接経費10万円を含む) - 研究課題:耐放射線動的再構成型プロセッサの研究開発
助成金名:中部電力 原子力安全技術研究所 原子力に係る公募研究(研究代表者)
助成期間:2019年5月~2021年3月
金額: 1100万円 - 研究課題:耐放射線FPGA(Field Programmable Gate Array)の研究開発
助成金名:中部電力 原子力安全技術研究所 原子力に係る公募研究(研究代表者)
助成期間:2014年5月~2016年3月
金額: 1000万円 - 研究課題:MEMS、ホログラムメモリを用いた光電子プロセッサ技術の研究
助成金名:浜松科学技術研究振興会・科学技術試験研究助成(研究代表者)
助成期間:2013年11月2日~2014年11月1日
金額: 40万円 - 研究課題:高放射線環境下向け光電子組み込みシステムの開発
助成金名:(財)大川情報通信基金(研究代表者)
助成期間:2012年4月1日~2013年3月31日
金額: 100万円 - 研究課題:自律再構成可能な高信頼性ホログラムVLSIの研究開発
助成金名:(財)熊谷科学技術振興財団(研究代表者)
助成期間:2008年4月1日~2009年3月31日
金額: 80万円 - 研究課題:3次元光電子融合デバイスのノンアライメント実装技術の研究開発
助成金名:(財)電子回路基板技術振興財団(研究代表者)
助成期間:2007年10月1日~2009年9月30日
金額: 100万円 - 研究課題:光再構成型ゲートアレイと再構成型プロセッサの実装
助成金名:地域研究開発促進拠点支援事業(RSP)
福岡県産業・科学技術振興財団(研究代表者)
助成期間:2002年度
金額: 250万円 - 研究課題:光再構成型ゲートアレイ
助成金名:テーマ探索・シーズ発掘事業研究
福岡県産業・科学技術振興財団(研究代表者)
助成期間:2001年度
金額: 45万円
●研究所・共同研究プロジェクト(6件)
- 研究課題:VLSIの高エネルギー中性子への耐用評価
助成金名:自然科学研究機構 核融合科学研究所 一般共同研究(研究代表者)
助成期間:2022年4月1日~2023年3月31日
金額: - 研究課題:核融合炉プラズマ診断用VLSIの高エネルギー中性子への耐用評価
助成金名:自然科学研究機構 核融合科学研究所 一般共同研究(研究代表者)
助成期間:2021年4月1日~2022年3月31日
金額: 13万円 - 研究課題:核融合炉向け耐放射線組み込みシステムの研究
助成金名:自然科学研究機構 核融合科学研究所 一般共同研究(研究代表者)
助成期間:2019年4月1日~2020年3月31日
金額: 18万円 - 研究課題:動的再構成型ビジョンVLSIの研究開発
助成金名:静岡大学電子工学研究所共同研究プロジェクト(研究代表者)
助成期間:2014年5月30日~2014年3月6日
金額: 28万5000円 - 研究課題:動的再構成型ビジョンチップの研究開発
助成金名:静岡大学電子工学研究所共同研究プロジェクト(研究代表者)
助成期間:2013年7月22日~2014年3月7日
金額: 67万円 - 研究課題:動的再構成型ビジョンVLSI
助成金名:静岡大学電子工学研究所共同研究プロジェクト(研究代表者)
助成期間:2012年5月23日~2013年3月9日
金額: 85万円 - 研究課題:動的再構成型ビジョンVLSI
助成金名:静岡大学電子工学研究所共同研究プロジェクト(研究代表者)
助成期間:2011年5月23日~2012年3月9日
金額: 100万円 - 研究課題:動的再構成型ビジョンチップの研究開発
助成金名:静岡大学電子工学研究所共同研究プロジェクト(研究代表者)
助成期間:2010年5月24日~2011年3月11日
金額: 75万円
●学内(静岡大学)競争的資金(3件)
- 教育研究プロジェクト推進経費(若手研究者支援経費)(70万円) 2011
- 工学部プロジェクト(80万円) 2011
- 工学部プロジェクト(80万円) 2010